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receptor dvd/cd manual de serviço modelo: ht303su-a2(sh33su-s/w)

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1.
2. VCC50 oc 1403 HB R409LR410 06 47 En caio 408 cos 47 16 C408 2 1470 46 LDO1 7 A417 c407 gO ur 0401 0402 R414 10K 100 10 KTA1504 KTA1504 AN Myce 5VA MOTOR FROM PICKUP iss 400K GND 4 CN402 L404 1408 0405 NO FHM VCC 1 e JIG401 e 10uH 10uH 25K3018 T PF 2 15402 VR DVD 16403 HB HB DVD LD e C414 E C445 416 C417 JIGA04 1408 100 22K 8407 PICKSEL 1 200 40 MON COM 5y 4 e A ANN 220 10 O uF 0 tur 16405 VR DVO DVD VR B re CABG C405 0 4 o 6 g END 7 116407 O 4uF 0 GND ela 16408 y 1401 HB Fle 18403 F Y JIG410 16444 R412 100 num 0404 D DE e 16412 VEN 25K3018 cli e 18413 0 33 1 8V sli e 16414 B FD is 218415 is VIGA P416 TH 15 Hoes tia e OPEN 0406 TI 17 e 147 KTA15441 0402 FO 18418 Q RL104 16419 10 SW PDIC 19 Au C411 GND 20 e 0 4uF 3412 24 16424 amp Hon 2 e 16422
3. 0010050 foco 00 00 0 0 0 0 0 0 0 0 0 do 200 2509 929 090000090 0009 900000 0000 95959 MS loc o So 9 8 q 99590000000 9 295950090 5255559 o HOP A 0 0 0 00 00 O O O a es 229907 SO do oo S e e 0508050000 os is 23099 E 2026 5 5095 50002 20 0290 1 a 8 see sore ES o 2 2 9 9 2059207 27920207 2050609 SO 9 5 OOOO 2 O O O O OO 00090 0 Won wo X o DOIS OO O O 0 O0 OO OO o 0 00 0 0 a 1703 709 P1902 3 020000 92502 920509 99909 JO S 0 0 0090505000 o o Mec N0 my E 00 0 0 0 OOo OO o 5 O CL See van E 5 2 5 99 0509000 0 Oo D q ooo 1201 E 9992959 5 207 cco SEEN ROLE ki 950 um o N 1 lo fof T SERT 5 c58 55 Ela 6512 R501 sa C512 R503 e NS 16504 Wo 9 999299 0090 a0 oo 0 ee ao COCHA a 999 92 B8 Midi MO 22 22
4. Interrupt control 4 gt I PLA Standby control 4 4 5 correct m e OF k Flash ROM o RC 55 gt X tal 5 gt E E 5100 lt interface 5101 4 0 lt Port O gt gt 0 4 lt gt Port 1 FRI B register Timer 1 A lt gt 2 lt C register Timer 4 lt 4 lt Port 7 gt ALU gt 5 K lt gt Port 8 a Timer 6 lt gt e ADC lt PSW INTO to INT7 gt Timers Noise filter d Base timer 4 lt Port 3 lt RAM PWM2 3 gt 4 Port C Stack pointer lt UART1 I Watchdog timer 4 UART2 On chip Debugger Direitos autorais 2008 LG Electronics Inc 2 35 Apenas para uso Interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o DESCRI O DO PIN Description Option Vss1 Vss2 Vss3 Power supply pin No 1 Vpp2 Vpp3 Power supply pin No Port 0 P00 to P07 8 bit I O port I O specifiable in 4 bit units Pull up resistor can be turned on and off in 4 bit units HOLD release input Port 0 interrupt input Shared Pins 5 Clock output system clock can selected from sub clock Timer 6 toggle output P07 T
5. N ag sx 0 gt z 2 2 om m Ser 85 RG O O O O O O OO AHAB S n n n n n gt gt a LOIT 48 47 46 45 44 43 42 41 40 39 38 37 36 35 34 33 P7O INTO TOLCP AN8 49 32 P32 UTX1 P71 INT1 TOHCP AN9 50 31 P33 URX1 P72 INT2 TOIN NKIN 51 30 P34 UTX2 P73 INT3 TOIN 52 29 P35 URX2 RES 153 28 P36 XT1 AN10 154 27 P37 2 11 55 26 P27 INT5 T1IN Vss1 156 LC87F5M64A 25 P26 INT5 T1IN CF1 57 24 P25 INT5 T1IN CF2 58 23 P24 INT5 T1IN INT7 59 22 P23INT4 T1IN P80 ANO 60 21 P22 INT4 T1IN P81 AN1 161 20 P21 INT4 T1IN P82 AN2 162 19 71 P20 INT4 T1IN INT6 10 500 163 18 7 7 11 510 5 0 164 17 P06 T60 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 3 289985682020 view 0 00 agen nn 5 p Noe gt Ra gt gt 5 N x 2 gt amp 0572 E N a Apenas para uso Interno da LGE 2 34 Direitos autorais 22008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de e DIAGRAMA DE BLOCOS
6. im M 1 5 v 06 5 V 0056 188 5 5 ne 3 5 V 2 Db 7 04 1252 q M 188 kS s 5 voi O STOPPED H 5 v 005 STOPPED FIG 3 1 FIG 3 2 3 Sinal de abrertura da bandeja 1 gat T 8 s chao LM LOAD To LOAD J 2 EN TROUT hd CLOSE TRIN RH 50 esa Ea a e 3 m T i E 8 I ED 4 2042Typel Mi MN 4 5 E pet 1 5 V DC OP 5 V DC 188 kS s Ais 5 V DC 2 V DC 5 0 STOPPED FIG 3 3 br ES Recs re 1 VINFC MUTE 2 is aie A VINK VINSL TRB 2 P411 5 REGO 1 RESET 3 TROPEN 6 TRCLOSE rev ao GND GD 4 weep 20 oit LOAD m vece Et vost vav Em 2 og vao E 8 VOFC VOTK Et e Direitos autorais 2008 LG Electronics Inc 2 15 Apenas para uso Interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o 4 SINAL RELATIVO A CONTROLE SLED CONDI O SEM DISCO
7. SE a 11 333 lt MICOM SECTION 000 35 TE s t 1 AMP_PDN q 33 AMP_PROTECT 5 2 SER PSR Rta EE 2 a ER ETE a STA Boy AMP_SD 10702 STA518 515 8 lt s m 10 gas 8 m Eo o w m 3838 P724 VCCSign 080 508 C736 35 u OUT2B nl ra m glk n 0 0 58 58 c710 TS vss 104 a vss E Q y IN2B GND2B 1707 8 il GND J IY 104 INCA GND2A ME ge a cns Rta gto 5 E VCC2A STE RES Sh EIS amp 470 6 te ses ouT2A 2 so S ul 8 5 TH_WAA OUT2A 15 58 a 1 1 5 E decoupling i FAULT OUT1B 1104 amp 220 10 amp 10 16 8 ASAP close to IC TRI STATE QUT B S TP709 Sin E aie Game z PHADN vec 8 ETE CONFIG GNDIB Mel 0 VL ENDIA _ 4 W VOD VCCIA RSA PM 58 voo Vol Sgr x ES RES 8 88 7 GND Reg OUT A yer ay Sea ae E ETE EH 5 18 ES GEES THES sabe ae GN Clem N C 58 A Ei iB TP708 AL a C701 h LES A 58 55 S a Mer ba ue 85 90 gt e F 4 T 5 EI 4 P 8 os m ed vm m ee ant 4 8 4 WF 0 amo ma PO EO fae 7 ea al
8. 2 75 DIAGRAMA DA PLACA DE TIMER P C HT353 gm BALIN o 9 0 0 0 0 SET 524652229 ROO eto 222 4 Eo gt OI NE TO 5 3 5 o 223 es TD 4 1630 255 550508909005 202690902600505500 DIAGRAMA DA PLACA DE TECLAS 53 2 76 fojojojo oo ojo jo COB 0303 o cao O am O 1 E m 0 192115225259 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o SECTION 3 VISTAS EXPLODIDAS UM TRI NGULO EQUIL TERO SERVE NOTAS O PONTO DE EXCLAMAGAO DENTRO DE SECAO DO GABINETE E ESTRUTURA CENTRAL PARA ALERTAR O PESSOAL T CNICO SOBRE A PRESEN A DE INSTRU ES DE SEGURAN A IMPORTANTES NA LITER ATURA DE MANUTEN O A Apenas para uso Interno da LGE 3 2 3 1 Direitos autorais 2008 LG Electronics Inc Apenas para efeitos de treinamento e de manuten o Todos os direitos reservados e VISTA EXPLODIDA DO MECANISMO DO DECK DP 12TV Todos os direitos reservados Direitos autorais 2008 LG Electronics Inc Apenas para efeitos de treinamento
9. X TAL 101 12 288MHZ LO S EXAM H H N TT REAR R 3 STAB18 10101 1 704 gt FRONT L PS9830B MODUL ATOR CENTER VIDEO SLIDE SANYO AUDIO STABIB gt MAIN MICOM ASASASR WOOFER x ay B a X TAL Ei 8 H 27MHZ lt D lt lt MT1389 L eE lt lt T ADC_BCK IC501 ADC DATA 9 3 S S Yy Y OPEN CLOSE FOCUS SLED zu ICAO PICK U 2 M R m 3 2 g a DRIVER pe y os 7 008 5890 5 x syy SLED IC301 MOTOR IC504 I L TC503 1 502 PDI6965 SDRAM FLASH EEPROM VED DRIVER Z CLOCK VFD BY38558901 7 2007 11 30 2 47 2 48 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o DIAGRAMAS DE CIRCUITO 1 DIAGRAMA DE CIRCUITO SMPS PRINCIPAL AVISO IMPORTANTE DE SEGURAN A QUANDO ESTIVER PRESTANDO MANUTENCAO NESTE CHASSI SOB NENHUMA CIRCUNSTANCIA O DESIGN ORIGINAL DEVERA SER MODIFICADO OU ALTERADO SEM A PERMISSAO DA LG ELECTRON ICS CORPORATION TODOS OS COMPONENTES COMPONENTES ESPECIAIS EST O SOMBREADOS NO ESQUEMA PARA FACIL IDENTIFICACAO ESTE DIAGRAMA DE CIRCUITO PODE O
10. lps 11 Os At 328 5 1 4 3 0441 MHz 1 1 V DCL 2 BS s Lv 2 DC 1 48 V 4 2 V DCL STOPPED FIG 1 4 2 CLOCK DA SDRAM 1 Clock principal de MT1389 L 27MHz X501 02 DCLK 93MHz Vp p 2 2 Vmax 2 7V 1 18 ns 1 88 V i 6 1 my 1 TAM TAN VA i vir Pepa EM638165 lps il 1 V 0054 At 10 48 ns l4 95 42 MHz 2 1 V DC 2 654 3 1 OR 2 DC 1 48 V 4 2 V DCR 0 STOPPED FIG 2 1 Apenas para uso Interno da LGE 2 14 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento de 3 SINAL DE DA 1 Sinal de abre fecha da bandeja 2 Sinal de fechamento da bandeja 3080 82 Reading Floppy Disk Drive 9 Dec 82 17 51 23
11. 4 2 e VISTA DO ALTO SEM A BANDEJA DO DISCO 4 2 VISTA DE BAIXO e ga waw was samasaa a as AA 4 2 DESMONTAGEM DO MECANISMO DO DECK 1 BASE PRINCIPAL CEASA RARAS 4 3 1 1 Grampo de Montagem do 4 3 1 1 1 Grampo da 4 3 1 1 2 Grampo do Maneio dna OR dr RE 4 3 1 1 3 GrampO SUDETION eii qood LATE 4 3 2 BANDEJA DO DISCO ADS teu dE a EEG A 4 3 3 SLED DE MONTAGEM DA BASE 4 4 3 1 Alimentador da Engrenagem 4 4 3 2 Melo da Engrenagem 4 4 3 3 Rack da Engrenagem 4 4 4 gt 4 gt 2252 5525 5 dessas SDS ROS 4 4 5 MONTAGEM DA MOLDURA CIMA EM BAIXO 4 5 6 CORREIA RR 4 5 7 GENGRENAGEM _ ATRASADA ATA DA SEA 4 5 8 CARREGANDO ENGRENAGEM 4 5 9 GUIA BAIXO va ce A 4 5 10 Carregando a Montagem PWB
12. JK203 JK202 JK201 TU101 JK204 JK702 COMPONENT CV HT JACK HMINAI AUX JACK DC JACK p 23PIN S Y a 14PIN 14PIN L x CABLE1 SM o 1 MD CLOCK DISPLAY FRONT PCB 12PIN MIC amp USB PCB JACK1 2 PORTABLE IN PN202 058 EBY38558901 7 2007 11 30 Direitos autorais 92008 LG Electronics Inc 2 45 2 46 Apenas para uso Interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o DIAGRAMA DE BLOCOS MIC IC2A1 BA3308 Be SIGNAL BUS TUNER DI RDS CLK RDS DATA TUN10O1 kz TUNER_MUTE CE DO CLK TUNER PORTABLE IN AUX SCART AUDIO SCART 10204 VIDEO S W 1692 2 L S SL 201 CS5345 ADC R R G B 6 Y Pb Pr OPTION 1 1 1 1 1 1 1 1 1 1 1 1 COMPONENT lt 1 Y pd 1 1 1 1 1 1 lt 5 MONITOR Apenas para uso Interno da LGE
13. m a E A Y E 2 md B d E 8 3 8 E E BH B E B 8 1 Gs E 8 58905 Ro a a a 2 5 2 gt p a g x xh 4 2 a e 3 2 E E S B 2 B PB 8 8 9 8 8 DIAGRAMA DE BLOCOS MUTE BIAS TRB2 RESET GND VCTL VCCD VOLD VOLD VOTK 28 27 26 25 24 23 22 21 20 19 18 17 16 15 GND PGND gt 2 10K Voltage UTE Detection 15K 10K W Spindle Actuator 25K T Driver 4X Driver 6x x Thermal C J Shut down 177 1 1 2 Vec2 i Veel 25K 10K rm Y A 25 Sled Actuator Y Driver 4X Driver 6x Pre DRV z TRAY DRIVE POND yai 10K Lah EL I a s l6 17 8 9 far 12 13 1 REGO2 VINSL REGO FWD REV VCCI VOTR VOSL VOSL VOFC Apenas para uso Interno LGE 2 32 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e DESCRI O DO PIN PIN No Pin Name Function 1 Input for focus driver 2 TRB_1 Connect to external transistor base 3 REGO2 Regulator voltage output connect to external transistor collector 4 VINSL Input for the sled driver 5
14. 2002 10 09 17 16 21 mor _ Norna 2002 10 09 12 23 57 Normal Stopped 352 1 SOONS s 500034 Stopped 215 SOGHS S 50004 RPE GH EET CHAO EN 1 00 Uli 1 00 ne Fun 4 DC mur H 1 I a I i T 4 w Edge CH1 F gis stints DA OH F a Normal Normal xi Mens 1 1 24 8690 2 35 V 1 06045 1 MA 7116 536nU 259 xi masc poe 116 536 xi EA EU i av 41 666700 ax Xem av 41 666700 lax m lax _ aee EmA Tispiaj Position coupling Probe JE Urrset Fanauiath Next Lever normar singe OFF phj 2 10 1 0 00 uf mun 1 2 R703 TP704 R720 TP711 3 2002 10 09 17 21 14 pH _ 4 2002 10 09 12 24 34 poH Normal Stpeiq 10 EE Stopped y 244 EE 1 00 Valiv NI ne il H 1 m Edge CH1 Ed epoca sa Edge F Normal Normal E 1 MA 774 8698 2 35 1 06005 L XL 774 0690nu 2 35 x fade io E x fades CPU 53 20318V
15. ff Eres 3 pen 125 1 00 4 L 3 w 1 5 s 1 11 v De d 1 V DC 180 kS s 1 V OC I 2 DD 1 48 V 4 2 v DC D STOPPED FIG 7 1 DVD B Dec 02 18 88 54 1 pn n Pa 8 Y G 28 ms 1 88 V 1 PE B Eres 2 ae 1 28 ms x 1 00 V 3123818815 i fe ge fi Eres 3 2 eof 8 E d 5 28 ms amp c TX eges Pe 1 80 V ovak 95 vsrU cP10413 94 TRCLOSE 1012 33 PICKSELA 2 NEM ervey E ER xx 3 501 LR cPIO40 81 e DD DVDD18 o p 5 s UD GP109 89 e PO 11 v De 88 2 1 V Dii 100 kS s H 1 v c 2 DD 1 40 V 4 2 v DC O STOPPED FIG 7 2 DVD l amp a a i a 8 4 E 3 3 3 b E de so sles Ha 8 88075 E 117 8 E M 1 als m ela BS g 508 8 5895 08595 5985 S S 2198 sls sis G Z S r 22528 88258 5582 88484 os 38803 23554453 8 1 501 284 8 83 Apenas para uso Interno da LGE 2 18 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o 16 Dec 82 9 15 41 Reading Floppu Disk Drive R Eres 1
16. al HON E Ii MIC amp USE SECTION a E E P D a al sl al al Lo OTe ao EE cito m 3 lo pita 9 989 y 4 gt 2 of de eg 2181212 88 Ll ad Sp TS E yu 5 C10 lt JAM UY x AE 48 FLt 16403 lelelelr EE EE E uf c 8 3 B VKK IET EEP_CLK j 3 8 Psi lu E 44 E e2 6 5 gt gt 72 14 13 DONO 4 ao su E 3 3 L104 EEP_DAT 3 8 x pap 221121 Bla Bgeb RX Y vo 11 6345 4 E amor 10 5315 1904 1 o deste o 6316 578 de 90 2 se 7g a EJ 3 PH SVAMICOM 7 BVA MICOM 9n 5 Sm RCU IN TP423 B BY 5 mA B 1 qe 5 6y 7 e Vau 3 3 2e 8 TP197 E 2 va on Hay 9 4 STBv LED EJ 10 5 PN O3 FL m cipa FR E 47 16 6 40 gla 1 D EN 14 oo d vu g 3 8 E g g E 2 ya amp 8 nie le le 8 lola le le gt 2 2 fa B a POWER HT303 HT353 C 1 2 SMD 2012 TYPE MICOM 07 11 23 A N EBY38558901 3 ye 5 2007 11 30 B C D E F G H J K L M N R s T Apenas para uso Interno da LGE 2 55 2 56 Dire
17. 1 Loot 18 1002 LDO2 19 AVDD33 2 1 20 Do DMO 21 EMO sim MT1383 m TRAY OPEN 23 TRAY CLOSE m 24 mo m 25 roo TRIN 26 27 ser USB_DP 28 USEN USB_DM 29 USB_V33 z ES E SIS m BSEC 5 kai Y 8 1 gis E 8 8 8 27 lala P on o o o lt OG DB ou D OE 45 gt gt 9 3 3 a O Soda ass 5 2 3 456 lt lt o a 33 lt 225582 32 3 a VREF gt DACVDDC s iS ct E VSTU GPIO13 j 3 SPDIF GPIO12 x x HSTR GPIO11 C50 1 LR GPIO10 1 DVDD18 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento de 3 ES LW 1 elo G ajaj los h Y m a sa 85 16 E amp 86 seno SB Y 65 pl 5 0 E wj g e E EM o gt Eor y cm T I vor ol SSAQYY SS aynw orpny 6t01d9 37714 E 907 390089 oH 0201d9 W9A V tg 401 ayrw otpny tz01d9 8157218 Bor moze ES
18. O SE O 4 MECANISMO DP 12TV O SE O 5 LISTA DE PE AS DE REPOSI O Direitos autorais 2008 LG Electronics Inc 1 1 Apenas para uso Interno LGE Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o SE O 1 GERAL PRECAU ES DE MANUTEN O NOTAS SOBRE O MANUSEIO DO CAPTADOR 1 Notas de transporte e armazenagem 1 O captador deve sempre ser mantido em sua embalagem condutiva at imediatamente antes do uso 2 O captador jamais deve ser objeto de press o externa ou impacto Armazenagem na embalagem condutiva Impacto de queda 2 Notas sobre reparo 1 O captador tem um magneto forte e portanto nunca deve ser deixado pr ximo a materiais magn ticos 2 O captador deve sempre ser manuseado de forma correta e cuidadosa tomando o cuidado de evitar press o externa e impactos Se for sujeito a press o forte ou impacto o resultado pode ser uma falha operacional e ou danos placa do circuito impresso 3 Todo e qualquer captador individualmente ajustado com um alto grau de precis o e por este motivo o ponto de ajuste e os parafusos de instala o NUNCA devem ser tocados 4 Os feixes de laser podem lesar os olhos JAMAIS permita que os feixes de laser entrem nos olhos Tamb m NUNCA ligue a pe a de sa da do laser do captador lente etc se ele estiver danificado NUNCA olhe diretamente para o
19. S 8 o o or 9 5 0 9 0 9 255 o 5525 00500 53 UD OM MRE O 0009 0 00 0 Woo oq 00999999 Direitos autorais 2008 LG Electronics Inc 2 69 2 70 Apenas para uso Interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento e de DIAGRAMA DA PLACA PRINCIPAL P C VISTA INFERIOR 9 0 046 0 0 0 O O O O O O 0 0 0 0 0 0 0 O ON O O O O O O O O 9 9 9 2055009 950052500 9 99 0 90 9 99 999 0000000 0 0 0 0 0 o 040 0 0 0 a OO OA o aO Doro 0 0 0 9 9 0 9 00 0 0 0 70200 929990000 6200000900 200000000 0 0 0 0202 0 o 0000000 0000 55000 90000 000 0 0 0 GOO 92020 9 9 O O O 9 0 0 0 0 O O O 0 0 O O 0 0 0 05007 LO OQ O70 0000 0000 000 o o o o OO 02020202002 LO 950095009505909500959095000092009 9592599 9 90020202 POOR y 200 eX 020200 92020 970297020 9920 290000 o 0000009 525959969500 9 0 0 9 000 0 979 9 o TC o ReorRight o OO 2 2 2 9500 99 0 900 o 9 9 5 20500 00500 9259 0 o GND Eq 7 C7H5 2 9 9 9 9070 2005002 077
20. q 2 o o o o 9 2 o o 2 AS o 9 o o o o O o 0 550 5959 202020202020 0 9050 0 6000000 9 0 CEB 595995929200 92 Wo 020202020202000 2 Q 0 020202020202000 0 52929295 0 0202020202020200 6 9 0 OO 0040900 x OOK OOO o 92925929929 22 9 929 0 0010 ES C526 COO 0507 50 X5 0 o 2 9 920 4 desa em 2o 08 0591 9 2 oO o 0 9 9 o 999999 2020 029 OO Xo 5070 o Po o o 2 0 OO oo o oo
21. 1 Regulator voltage output connect to external transistor collector 6 FWD Tray driver forward input 7 REV Tray driver reverse input 8 Vccl Vcc for pre drive block and power block of sled and tray 9 VOTR Tray driver output 10 VOTR Tray driver output 11 VOSL Sled driver output 12 VOSL Sled driver output 13 VOFC Focus driver output 14 VOFC Focus driver output 15 VOTK Tracking driver output 16 VOTK Tracking driver output 17 VOLD Spindle driver output 18 VOLD Spindle driver output 19 Vcc2 Vcc for power block of spindle tracking and focus 20 VCCD Inpu for voltage detection 21 VCTL Speed control input of tray driver 22 GND Ground 23 VINLD Input for spindle driver 24 RSET Output for voltage detection 25 TRB_2 Connect to external transistor base 26 VINTK Input for tracking driver 27 BIAS Input for reference voltage 28 MUTE Input for mute control Notes Symbol of and output of drivers means polarity to Input pin For example if voltage of pinl is high pin14 is high Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados 2 33 Apenas para uso Interno da LGE Apenas para efeitos de treinamento e de manuten o 3 1C101 MICOM CONFIGURA O DO PIN
22. d 607 oum H g adoos 077 oia 01 001 iH em wW 2SSAOVOV ZW yssA9vuv EM 391 48v DIS SIS OH E E NW n 10024 E26 40 0 E SSAOVV 83nu otrpnv 6r0Ico 0c0Id9 WOAQV 83nu otpny T20Id9 eSSAOVOV TSSAOVOV OId9 34 Juv OId9 SUV O0Id9 HV TOId9 W 0199 5717 OId9 H31N32 3V q remar O 3 8138 AhOdO NIJH NNId0 93H dNIdO H3U P P C4 2 395830 Freg C4 15 73317kHz ZOUSAliv STOHSAtin Normal 50 5 lt 2115 gt 18 0 400 Edge uto Full FIG 11 2 CHa 10 1 0 500 U diu DC gt ABCK 2 304MHZ 19 52 51 2002 12 11 18 37 08 Stopped 2 Y 23 02 12 SAIDA DE AUDIO MT1389 L 1 Sinal relativo a Audio 2 ALRCK 48KHZ 588 MS s STOPPED DC 1 88 V 1 L oooco gt gt gt gt NEY 5 ps Apenas para uso Interno da LGE 2 23 FIG 12 1 Direitos autorais 2008 LG Electronics Inc Apenas para efeitos de treinamento e de manuten o Todos os direitos reservados 13 SINAIS DE DVD E AMPLIFICADOR
23. s ioo o o o 000 0 ED o o o o o o X701 12 288MHz ole MO o 00000000 9504 512 16 AN DD om E 5 2007 12 24 99 ma 92 ug e o o om o o o EISE 5 2 c En e 97 CS O DO ses lo DU ag 9 RES 0102 5 o O iso 2500999 c OL oo BL b 8 TU101 Doo 5 a 8 EL 2 0 0 0 0 0 0 0 2922 O E is amp H ED 4 a o o Dos E E 528 O o E oo 9 colo o 9459 9 000000000 ka 2 os 6530 V B8 E E ss 2 d 94209 E o e e D apos 0 A 59 yo O P o 6529 o o o C526 c520 D 3 axe Solo E 8 X101 9 8304MHz 0 P D SA ipo 2 5 i OA E 2 6 con Ho HE So mes 2 E 208 ee o 5 E yO o o Bo o o d loea ph ste o O E EO o OE o ES 19 ag lor o o o s 858 B 995 o 99 PPP 5090 0 EA 5 Ee o B B u 10000000000 os R B 5 o mao o oS o 9 Senora 959295 Emm o o ES nis m 99 900 o 9 os 050000000 9 90225000 0095255 e e o E 92020 9 OOOO occ ES Riad OOO a 9200 00
24. eO 2 GO COCO 9 e o ox 9000 050505050 0 o 0 0 oo 00 529 529 929 9 0 9 0 0 So o gt 009 o o oo 0 o o o o o 0 o 0 o 20202020F 5 0 9 o 5050 00 9000 LOO OO 9 X 20 929 Ox 0292 OO o o o 70 97 b Y 5 lt 20 09 9 9 L 555559900 55959592929 0 0 0 0 0 0 0 0 0 0 OO OQ Nn o 29 999295929959 02565 o O 2 A o gt o o 2 gt 2 2 o 0 0 0 900 o Po 5 lt gt 050 o o o o 20 Ox Ox 69000 9 9259 9 TPIS 2 2 5 99 o 2 255554 050500 92 0 o 2 902090 o FO o ooo x 929 a Sos 552 9 00000000 0 9 9 o 0 509 dO 299 0 929 059 DO 920709290 57022 9 99702029 9222 925255 959 9 9 9 97 oo 9 00 o 0006 9 9 90 0 O 90 070 000 999 297 20509009 o 020 ooo o 7 OO
25. EM Pd 2 67 FAt_O mika Es HO FAt onto ovas E 10703 STA51B 515 0 10 VDD65 P E cx IC704 ro ysse4 P 332 2042 36 1 cla a mE Pato oyssea Tiros m VCCSign GND SUB Sse E R LO 14 9747 100 35 2 E S T lt _0 PS9830B Es R704 100 72707 WA 037 00128 URS S m n mex E w GND Sa 34 3 10412012 5a ALt_O 5 10 vssso PQ TE744 VIR vss q O AL Leong BS FRY 33 4 5 0 18 enna BB vss VCC2B 2 T8 FO RL BCK is NS ct 32 5 8 0 TACK PS mas E IN2B GND2B HO ACK gt 213 10 56 P 752 CEN 0 LRC a en mas ES 4100 TP704 FLY 31 INCA GND2A TE LO cen PL 30 7 fur 3216 WF O 715 ed INB VCC2A END LO Sit DADATAO ES 9710 afm Pa pat 29 B wo DATO 5 rs wi e iia meu pi AMD SD za NA E 4 DADATAE E lt OUT2A ME Egg ge 8 E 27 10 5 8 R765 766 AT 81848 gu s t 018 B E 7527 52 2 1 0 T uU BEL sex TRI STATE OUTIB a 5 n cme afez AMP_PON 9728 ST 12 C 53 5 104 2 gt PHAON 8 8 i ene 13 c Cu 03 201P GND CONFIG dur 3246 k w CM CM 14 C lt FO FN 3 GND 1704 8728 a Dni yecdA 15 m 220 amp Eta GND rr apo 5218
26. LGE Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o 2 CIRCUITO FRONTAL 1 2 VERIFIQUE SE PN103 EST OK O INDICADOR ERMELHO APAGA O DIGITRON EST LIGADO NORMALMENTE NAO ERIFIQUE SE ALIMENTA O DA RENTE ESTA OK VERIFIQUE SE TODOS OS BOT ES EST O OK VERIFIQUE SE RECOMON EST OK VERIFIQUE SE RC2 ESTA OK sim B D FRONTAL Apenas para uso Interno da LGE 2 2 NAO NAO NAO RECONECTE O CONSULTE A PARTE DE SMPS VERIFIQUE ESQUEMA E RESOLDAGEM Direitos autorais 22008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o 3 FRONT CIRCUIT 2 2 R345 R350 CONSULTE CIRCUITO MICOM voltagem em RC2 est ok 5V sim Resolde ou substitua RC2 P Direitos autorais 92008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o Verifique se NAO alimenta o da frente 5 5 5 est SIM Verifique se NAO CONSULTE o sinal de Recomon do pino 5 de PN301 CIRCUITO MICOM est ok SIM Verifique sea 2 3 Verifique alimenta o frente CONSULTE SMPS est OK SIM ERIFIQUE SE
27. RFIN Analog Input AC coupled DVD RF signal input RFIN Analog Input Main beam RF AC input path RFH RFA Analog Input Analog Input Main beam RF AC input path RF main beam input RFB Analog Input RF main beam input B RFG Analog Input RF main beam input RFD Analog Input RF main beam input D RFE Analog Input RF sub beam input E RFF Analog Input RF sub beam input E AVDD18 2 Analog power Analog 1 8V power AVDD33 1 Analog power Analog 3 3V power XTALI Input 27MHz crystal input XTALO Output 27MHz crystal output AGND33 Analog Ground Analog Ground V20 Analog output Reference voltage 2 0V V14 Analog output Reference voltage 1 4V REXT Analog Input Current reference input It generates reference current for RF path Connect an external 15K resistor to this pin and AVSS MDI1 Analog Input Laser power monitor input MDI2 Analog Input Laser power monitor input LDO1 Analog Output Laser driver output LDO2 Analog Output Laser driver output AVDD33 2 DMO Analog Power Analog Output Analog 3 3V power Disk motor control output PWM output FMO Analog Output Feed motor control PWM output TRAY OPEN Analog Output Tray PWM output Tray open output TRAY CLOSE Analog Output Tray PWM output Tray close outpu
28. 5 RIBO o 520202020 9 SPO cooo O O O Oq REIS e NMI adi IO AS 92292059050 3 o TPIBIG t 92009 9507070700 0000 Ea TP182 00 5000000 040 909 R271 B cmg O TL 50725202729 8270 a opo 52909 C768 9 5 R103 9 5 RIOZ o 9 o oo RIOS 9 9 o ORE E ox o E E p T Rios 107 88 Dhia 9 ENS 2 OR226 x 2 o pe 02050505000 O EB O ROO O Ll r o 5 Bobo o o o oo lodo o o go E 1 BB J gt 0 0 0 0000000 O 20214 0206 2021 129 550 Q R101 Eco o JK201 0205 130 o _ DO o ooo 9 0000007 9000 337373 KS 020 020 8 9 05080 oMoMoMo RSS 9 2009 52 207070 0 000907090 o 555000507050 ES o O o o BB 92 950 95 0 9 2 5 92 9 Do 9595 lt 0 00 9 9 0 0 070 05050 0 00 00 9 0 070 000 o C132 co CO o o o o OO o 90 0 O 09 900 969 o oco o 990 9092 9095000000 9090 o OOO O 0209 90 0 CC o 29 0 00 oo 0 0 co 9920 o O OS oO APO 920 9 2050 09050 GOLO 000 0907 rope 9 0502 lt 92020092 7 0400 92 O gt
29. AGND18 DVDD18 Analog Ground Analog Ground General Power Ground 7 Power 1 8V power pin for internal digital circuitry Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e Apenas para uso Interno da LGE 2 28 Description 79 DVSS18 Ground 1 8V Ground pin for internal digital circuitry 50 68 84 DVDD33 Power 3 3V power pin for internal digital circuitry 60 DVSS Ground 3 3V Ground pin for internal digital circuitry Micro Controller Flash I nterface and GPIO 12 InOut 1 General purpose IO 3 8mA SR 2 Microcontroller external interrupt 1 PD SMT InOut 4 PD General purpose IO 4 InOut 4 PD General purpose IO 6 InOut 8mA SR Serial Flash Chip Select PU SMT InOut 8mA SR Serial Flash Dout PD SMT InOut 8mA SR Serial Flash Din PU SMT InOut 8mA SR Serial Flash Clock PD SMT InOut 1 Microcontroller port 1 6 8mA SR 2 2 clock pin PU SMT InOut 1 Microcontroller port 1 7 4mA SR 2 2 data pin PU SMT Input PD SMT Microcontroller ICE mode enable Input PU SMT Power on reset input active low Input SMT IR control signal input Dram Interface 37 Sorted by position InOut AMA DRAM data 0 InOut 4mA InOut 4mA InOut 4 DRAM data 3 InOut 4mA InOut AMA DRAM data 5 InOut 4 data 6 InOut 4mA InOu
30. 9 Dec 02 18 43 08 4 5 1004 28 i 181002 1 00 Y 19 AVDD33 2 I iP 1 80 o B Eres 2 24 2 1 V 2 TRAY OPEN 22 TRAY CLOSE E i HH 2 rgo IC501 t pem mem emp L 3 25 26 2 00 V H H vew MT 14391 HR T USB_DP MU 1 1 28 4 vaga m USB_DM 28 ltr eo re A 4 Lua USB_V33 2 00 Y BUT 7016 30 GND NE 31 a NC 32 gt Es UsB vis 11 v 065 5 DC 188 kS s 2 v 2 DC 1 40 V BZ v os H STOPPED te E Apenas para uso Interno LGE 2 16 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento de 5 SINAL RELATIVO CONTROLE DE LENTE CONDI O SEM DISCO 9 Dec 82 8 55 08 fi Erest1 2 5 5 208 m4 Eres 3 Os 8 50 V 1 28 mv 2 50 my 50 4 2 DC DC DC DC 6 SINAL RELATIVO A CONTROLE DA POT NCIA DO LASER CONDI O SEM 10 0 02 10 01 32 1 As 1 88 V N G 3 lt lt lt lt DC DC DC DC Ean Reading Floppy Disk Drive 2 000 78 V FIG 5 1 e 2 DC 1 48
31. C101 est o erificar se 0 Pino 49 de IC101 est alto Substituir IC 101 Apare SIM UX SART Fb gt 87 5 no F NAO gt Consultar SMPS Consultar circuito do oscilador verificar sinal de reset de 101 NAO gt gt Verificar linha 3 3V NAO Verificar circuito da se o de alimenta o 2 12 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o DETALHES E SINAIS DO TESTE DE SISTEMA E DEPURA O 1 Sinal do sistema 27MHz clock reset flash R W 1 1 Clock principal de MT1389 L em 27MHz X501 9 0 02 13 59 47 1 T 28 ns 1 90 V E 22 t 58 ns T Div pr At 37 1 ns 1 26 97 MHz 2 1 V OC 2 55 5 3 1 D 2 DC 1 40 V 4 2 v DC STOPPED FIG 1 1 2 Reset de MT1389 L esta alto e ativo Power Cord in 9 Dec 82 7 87 27 Troe sos 5 TUI tuu ae 45 48 65 62 Ncn open grain pull up BY cra Pan 20 Nch open drain SIMPLINK pull up 3 3y Pes INTRA I C108 1M 59 Pin 67 58 9 8304 4 Download pin 37 38 39 53 56 59 P23 INT KEY RIFA 100
32. OUT A BIS FR 0 x GND Reg OUT4A e C747 5 olt 7 R7H GNO Clean N C 1000 50V 8 9 ki 7 8 2 7 5 0 799 H ia D Sta 1 0 204 i lt _ LR GND 58 E 104021 2 su e 8 C790 5 E x qu CH 103120 HT303 HT353 E q SEL 933025 Bo 33005 PART 07 11 23 GND 104 2 0 1 B D E F G H J K M N 9 P Q R 5 Apenas para uso Interno LGE 2 59 2 60 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o 7 DIAGRAMA DO CIRCUITO Todos os direitos reservados Apenas para efeitos de treinamento e de 12 PRA 12v PEL VCC50 E eu lt Ad USBN lt C2F1 core E 47 47 de IC2AL BA3308 Te gt 2t S wu 8 2 8 D 1 D 2 3 o 42 4 i DGND 5 8201 8204 2 2 R2E9 PTB L 6 3 9K 3 9K lt 90 10K 40K A 207 PTB R 8 5 A _ cept a DVD SECTION C2EG 9 10 16V 8 Tove 5 C201 TT RaF1 20 10 4
33. lt lt lt lt occ Ex thx EO Nem a x E 18 Dec 82 9 16 16 A 2 DC 1 48 V FIG 7 3 CD 0 1 50 ms 1 00 Y B Erest 2 50 ms 1 00 Y M Erest3 50 ms 1 00 Y 1444 HH 5 11 DG 2 1 V OC x B 1 v ocx 4 2 v DCL o 2 001 404 FIG 7 4 CD Direitos autorais 92008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o 188 kS s STOPPED 188 kS s STOPPED 2 19 p a 221 pun als E ao 318 8885 agg 8028 885 0338 8 5 96 5 VREF DACVDDC i vsrU GP1043 94 TROLOSE 6 2 93 2 HsTR GP1044 92 TROUT LR gPI040 91 viga q DD DO 501 DVOD48 m 9 D tur UD GP109 89 2 0 in vsro cpros 88 TROPEN gm xU a m af al ala 8 8 E 8 A 4 E 7 8 8 8 8 8 5 818 o ao ae le ses as B Susa 8 A H i lis 5 s als ls mE ola A S cud NIS 508 Ei BT E BTE 8 8 ala ol d fas ae 3292233228333 228 EEE 2 a
34. o DIAGRAMA DE BLOCO INTERNO DOS ICs 1 IC501 MPEG MT1389L CONFIGURA O DO PIN RFA RFB RFC RFD RFE RFF AVDD18_2 AVDD33_1 XTALO AGND33 v20 14 MDI2 LDO1 LDO2 AVDD33 2 DMO FMO TRAY OPEN TRAY CLOSE TRO FOO FG GPIO2 USB_DP USB_DM VDD33_USB VSS33 USB PAD VRT VDD18 USB Direitos autorais 2008 LG Electronics Inc gt gt 2 N a Y gt y gt 5 2 2 Pos 2 SER gt gt gt gt gt gt gt S cem zme 59h00 gt gt 2 2 998 5585225 pSdsgapricdr 55 8 gt oO227730 gt 05322FFROP 20868 lt lt o lt 220025 DOTEVON lt lt lt lt O 9g 582 0005 lt 525055000 s 7 1 96 2 95 3 94 4 93 5 92 6 91 7 90 8 89 9 88 10 87 11 86 12 85 13 84 14 83 15 82 16 81 17 80 18 79 19 78 20 77 21 76 22 75 23 74 24 73 25 72 26 71 27 70 28 69 29 68 30 67 31 66 32 65 w w w w GQ K K K K R K K K K O O 59995859960 g m z gt 2 25 Todos os direitos reservados Apenas para efeitos de treinamento de manuten o VREF DACVDDC GPIO13 SPDIF GPIO12 GP
35. 4 5 11 BASE PRINCIPAL ag 4 5 VISTA EXPLODIDA 1 MECANISMO DO DECK VISTA EXPLODIDA DP 12TV 4 6 Direitos de c pia O 2008 LG Electronics Inc 4 1 Para uso interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento e prop sitos de servicos LOCALIZANDO PE AS DO MECANISMO DO DECK VISTA DO ALTO VISTA DE BAIXO Para uso interno da LGE Procedure Parts Fixing Type D Fig Starting No embly 4 1 Assembly Disc Plate Magnet Clam
36. 7 50V R201 o CUF 515 MIC2 11 o AW AM O ED MIC SIG MICA 12 ih DE 910 z 10 16V C204 2 C208 33nF o para 8202 10K 3 3K 8205 R2F3 1k tk C2D3 boca it 22 50 22 50 B RS lt MICOM SECTION C205 L20 1 104 MIC DET_ gt MIC_DET HH HT303 HT353 MIC 07 11 23 jY3B8558901 6 2007 11 30 H J K L R 5 T Direitos autorais 92008 LG Electronics Inc 2 61 2 62 Apenas para uso Interno da LGE 8 DIAGRAMA DO CIRCUITO FRONTAL 12 11 10 015301 FL DISPLAY 6315 RX 6315 CLK PN302 STBY LED STBY LED KEY 0640 AMP TO FRONT 8886858858 EE VOL LED crio VOL LEDZ VOL LED3 3617 6942 LED4 VEE osc 1030 1 SG16 kS16 DOUT 5615 D PT6315 5613 STB R35 00K FLt FL VKK N C DENO DAND 6315 Ax cae M7uF 50y C303 404 090 337 100K R362 63 5 nx 6315 CLK 6315 58 1307 R363 5315 6315 678 0950 BVA MICOM DEND RCU IN KEY VOL_DN STBY LED PN301 0304 2203 RCU IN el do 0 do VOL UP VOL DN STBY LED 1 301 224 2 VOLUME VOL30 4 Apenas para uso Interno LG
37. 9 52 2250 990000 00 000000 00 0 O5 o0 959 cioe e e OS 0 0 0 0 0 0 0 0 0 0 0 0 040 020400 o 9 9 0 0 0 0 0 0 0 0 9 0 9 9 9 9 0 9 09 0 CR A O O VOO O O O O OO O EOS 50900100009 o o 2 o 05000 00 020 9 OTK ORA SOOO OOO 99 9 9 0 lt 959 20 99 9 9 909090 99010 o o o X 595929 529 PL CIS 0209590059 529202929 0009000000 0 0 0 020509050 CBL 2 o1 o e o 2555 OO O 55523 OO 555 59505002 OX o OOO 05050 so o XX 222979 50 q 202 50 o o oco oO Oe S o 0000 0000000009090 0 900505000000 55555 o 22959 920 SO o 000000 0000000000 TP121 2 90 Soros o 9590959005900 2000009 o 9 52555 020902070 92029 99900 00050 07050 920202020 0 070 000 OO 6 0 0 0 0005050705020 29 950500500050 0 692 9555200 20005000050 9 9 50 9 9 000000 55 702292070 00040 0505009 000009 9 99090909 o DO 0 0
38. Desaperte 1 Parafuso S5 2 Destranque o Loading Motor C2 do Gancho H1 na Base Principal 3 Destranque 2 Presilhas L6 e separe o Carregador de Montagem PWB da Base Principal 11 BASE PRINCIPAL FIG 4 4 Para uso interno da LGE MECANISMO DO DECK VISTA EXPLODIDA DP 12TV Direitos de c pia O 2008 LG Electronics Inc 4 6 Para uso interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento e prop sitos de servi os
39. af E dg ed 3 alel als s 5 STU TU101 RESET OPTION cela Z Z ON BOARD TUNER USING 2007 SANYO CHIP Not used lee ga s s zm E 1 102 4 94 14 f 90 KI 2042 s s e e 3 e e 3 s vu 8 1RI73 PLL CLK 3 i creel T nA 8 BERS 855888 TUNED Ale 1 P70 INTO TOLCP ANS 3 P3e UTX1 RO 6 0 gt 7 2 2 z L mE Fes imo 9 BCLLO poss ten B150 yyy 100 a TELOA eum P SDAIPLL DI 4 O B830 5345 TUER DAT AR rest reset s a m a 8134 100 16 9 4 3 N CIPLL D0 AMP PROTECT 27 9136 100 USING 2008 MATSUSITA CHIP 100 79119 75 100 R G B VIDEO P27 INTB TIIN 7 ROS CLK isst TP477 8137 100 PLL CLK ROS DAT 3 402 40 9 8304 2 57 4 TITS 8138 7100 ROS DAT ged Ku Sait elo ee uyu wanqa qali n 3 a P SENSE 88 do C109 1M m Pin 67 88 9 830467 PAM REIN 400 a Download pin pin 37 38 39 53 56 59 P23 IN QUE l Y E Key R F4 00 60 Tei71 A139 100 PLL DO ul a T gt PBO ANO P22 INTAF LER em 580 2 pire gt Sl atat ADUN g g a PB2 AN2 Pal AIN INTE SPI DI as la el E ia 6 Bes Eom EVAT sismo
40. dx aeons aY dx mess aY 41 666208 Lax ream Em Dax ream Em guto F singt sal singe a R704 707 R709 TP713 or R717 705 5 2002 10 09 17 21 53 p _ Norna 6 2002 10 09 17 23 18 Norm Stopped y 145 Stopped y 107 o CEEE 1 00 ne Fall 1 ll B Ed Edge CHa F Tia Edge CH1 Normal Normal 1 06005 1 116 536nU 2 35 0 1 0 74 0690m 2 35 x fade iow 116 S36nu x fades 117 2747869810 dx Eos ay 0 000000 dx mess aY 0 000000 Lax Somme Em Lax ream Em guto Singte sun F singe S R707 TP702 R701 TP708 a aaa Pee ee 84 EFE 2525 amp m TP708 s 10 5573 10 0072 Entro TP702 ARt PW7 M R709 4 100 TP713 ct 100066 C706 220 10 4 IO VODES P IC704 10 5564 05563 R747 400 TP705 Wet 598308 a R704 4100 TP707 WES n R720 y 100 711 FR BE C727 104 10 5587 10 0055 R703 yy 100 TP704 FL mua 10 vss53 PyWe_p 8 8 g 5 7988335 suus Apenas para uso Interno da LGE 2 24 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten
41. 4 7K 88 1 1 20 Ha Sa 50y M 11 2 I eae T I 032 JE Tenia 4 3 me C941 7 ESI 9 z 100UF 16V C904 W O O4UF 630Y I 11 1 I C93 zB Ps EN 150UF 450V jl 4 8 8 O T gt ii gt L 907 I 2 to 1 roo gt 3 1 L E 4 7 B o mes I 5 ia E PE C T 8 Lew 6 4000 1027 x 3 in ca 0 C902 9 Hey 1000P 250V I LL I l ma 9 e AN 6 5 5b s 1000P 450V 18 lo bx o 7 Avin ISS 4 e eo Z S 095 18 Qu B 4 5 I 16804 58 d 3 qu 5 LS S C908 8 24 A7uF 50V C937 CM902 E 9 2 bs ge pras 0 2 O AUF XCAP ime 78 p aa e 4 4K an 1 ES e I t 7 7 1 901 T Ren i E Allie id Ecos Dn 4 Rom _ i Y 10002 16 AN AN WIRELESS OPTION 938 2 K 9942 1000UF 16VK 0940 104 TIT THSO1 R943 220 GND I 5 Ohm L gt WIRELESS OPTION CM901 e I TE uem s E FEN ize 8900 cop 5 1 5 1 2W GND 9 te e m T 9 2 1UF 50V E rou 9904 s A Es Ds co 140681 4 4 c e 470pF kV gee 5 em D VCC 5 8 q E 3 BAL 250 8 m
42. 60 4 PBO ANO EN P2 INT MIC DET gt 1 aE PAITAAN amp paaano Sora ra 521 01 UNY 00 el 8 E R 2 5 00 00 4 msogo zi EU mu ER g ous BSS ae eT ee amp amp a amp S Z E 555 1 AV POC 2 aS R1A2 100 R14 SPI CLK gt DC 188 kS s r 2 DC 1 48 V lt TE DC STOPPED 3888830582 H 1 1 1 1 1 dl q E EL Ww Nie ei ccc E Ex FIG 1 2 4 x lt 4 sSssssas sss BE 501 Direitos autorais 02008 LG Electronics Inc 2 13 Apenas para uso Interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento de manuten o 3 Flash R W permite sinal durante download 9 Dec 82 Reading Floppy Disk Drive 17 27 47 pss I a 2 ys TE 2 2 88 V 1 eo CN501 4 gt 10503 4 SST25VF080B o 7 5 5 11 2 s o eg
43. 902 page 1 A ao al STR W6253 cul ol t 50 _ 4 LS Los a in A TES S OCP FM GND 9 in in Buh s m S EE ii ka e UG4D 4 i 5 E u a o 3 10 GBOUF 50V TT E SERA END z o 9913 gt m i 0 1521 Sa 5 LI BR IL R TRI 41 3 pc TIT BK wH ES Bak t GND I m I Y E 1UF 50V P958 JE 1 Pete 955 Guss pam SCHEMATIC SMPS WIDE A HT303 HT302 C904 urcast 4 NOTES Symbol denotes DC chassis ground EBY 39308001 1 N 100uF 450V oe D a E 15002 450 NOTE A Warning S Parts that are shaded are critical 2007 11 30 H K L M N 5 T Direitos autorais 2008 LG Electronics Inc 2 49 2 50 Apenas para uso Interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento e de 2 DIAGRAMA DO CIRCUITO MPEG amp amp E 8 4 gas 8 8 E g ss Y 5 5 7 7 8 8 8 am 12 BES a8 K us 8 TE A pet D las cais STSSTA lor S s lt SPI 00 220 10 ii PAPA v s Ena Sou C510 0 10 5 SLE gt SPI CLK i LT BUT gt 51 ul po EMULATOR v
44. AIN6B AIN1A 11 26 AINGA AIN1B 12 25 MICBIAS 13 14 15 16 17 18 19 20 21 22 23 24 TEE LL Z m zz lt lt Apenas para uso Interno da LGE 2 38 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de e DIAGRAMA DE BLOCOS 3 3 to 5V e e e 3 3V to 5V 104F 0 1 uF 0 1 uF Ho uF Im Y 1 8V 4 3 3 uF to 5V VLS PGAOUTA gt 3 3 PGAOUTB gt m Digital Audio pd SCLK AIN1A JE Left Analog Input 1 Capture LRCK 1800 pF 40 pr 100 100k SDOUT VW aL 1800 pF T E 100 190k AIN1B Right Analog Input 1 lt INT AINZA Left Analog Input 2 OVFL 1800 _ 100 100k RESET Micro 100 k e gt 1800 pF Controller m AIN2B Right Analog Input 2 4 e SDA CDOUT gt AD1 CDIN AIN3A Left Analog Input 3 i 1800 109 100k 1800 pF ee 100 1905s 2k 2k Right Analog Input 3 See Note 1 1 8V a oq VLC AIN4A MICIN1 Left Analog Input 4 to 5V L o4 nF 1800 pFx_ 100 400k Za 1800 pF T d 100 AER 2 Right Analog Input 4 Ne AIN5A ae M Left Analog Inpu
45. BASE MAIN BOTTOM SIDE VIEW 2 BANDEJA DO DISCO FIG 4 2 1 Insira e empurre um Driver no furo de eje o de emerg ncia A ao lado direito ou coloque o Driver na Alavanca B da Engrenagem de Emerg ncia e puxe a Alavanca B na dire o da seta de forma que a Bandeja do Disco ejetada cerca de 15 20mm 2 Puxe a Bandeja do Disco at que ela se separe completamente da Base Principal Para uso interno da LGE RUBBER DAMPER Distinguish upper lower sides Assemble with care RUBBER DAMPER Distinguish upper and lower sides RUBBER DAMPER Assemble with care d S2 S N RUBBER DAMPER GEAR RACK SPINDLE MOTOR ASSEMBLY 3 SLED DE DA BASE 3 3 Rack da Engrenagem FIG 4 3 1 Solte o parafuso 53 1 Solte os 4 Parafusos S2 2 2 Desconecte 1 4 DE BORRACHA FIG 4 3 3 1 Alimentador de engrenagem 3 2 Meio da Engrenagem Para uso interno da LGE 4 4 Direitos de c pia O 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e prop sitos de servi os Direitos de c pia O 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e prop sitos de servicos GEAR LOADING GEAR PULLEY SCREW INSERTION TORGUE CONTROL 800gf DOWN 5 MONTAGEM DA MOLDURA CIMA EM BAIXO FIG 4 4 Nota Coloque a face da Base Principal vi
46. CDIN is the input data line for the control port interface in SPI Mode VLC 5 ControlPort Power Input Determines the required signal level for the control port interface Refer to the Recommended Operating Conditions for appropriate voltages RESET 6 Reset Input The device enters a low power mode when this is driven low AIN3A 7 Stereo Analog Input3 Input The full scale level is specified in the ADC Analog Characteristics AIN3B 8 specification table AIN2A 9 Stereo Analog Input2 Input The full scale level is specified in the ADC Analog Characteristics AIN2B 10 specification table AIN1A 11 Stereo Analog Input1 Input The full scale level is specified in the ADC Analog Characteristics AIN1B 12 specification table AGND 13 Analog Ground Input Ground reference for the internal analog section VA 14 Analog Power Input Positive power for the internal analog section AFILTA 15 Antialias Filter Connection Output Antialias filter connection for the channel A ADC input AFILTB 16 Antalias Filter Connection Output Antialias filter connection for the channel B ADC input 17 Quiescent Voltage Output Filter connection for the internal quiescent reference voltage TSTO 18 Test Pin Output This pin must be left unconnected FILT 19 Positive Voltage Reference Output Positive reference voltage for the internal sampling circuits TSTO 20 TestPin This pin must left unconnected AIN4A MICIN1 21 Stereo Analog Inp
47. FFO gt nro TROUT gt TROUT TRIN gt TRIN PICKSEL4 gt PICKSEL4 8425 33K GND HT303 Z HT353 07 11 23 EBY38558901 2 2007 11 30 Apenas para uso Interno da LGE 4 DIAGRAMA DO CIRCUITO lt lt MICOM SECTION gt 12 lt AMP SECTION XI O SECTION amp d lt MPEG SECTION E 5 E e 332 y a 288 3938 5 sas g 8 22 5888 5555 8 8 gt 11 000 0 00 0 000 0 0000 D Q it 9 243 g lg EO 7 EME EIN a 8 ass B gg 8 5158 El Seg 33 3 484 5 8 8 8 8 Mer 2 2 RM 100 10 R AS 100 RESET OPTION x x R BO USED EREEEEBR 00 x er EE Ex a amine ELSE y 8 8 __ B c M EET 55 55 J E JA 5 224
48. Serial AudioData Output Output Output for two s complement serial audio data SCLK 42 Serial Clock Input Output Serial clock for the serial audio interface Left Right Clock Input Output Determines which channel Left or Right is currently active on the LRCK 43 serial audio data line MCLK 44 Master Clock Input Output Clock source for the ADC s delta sigma modulators DGND 45 Digital Ground Input Ground reference for the internal digital section VD 46 Digital Power Input Positive power for the internal digital section INT 47 Interrupt Output Indicates an interrupt condition has occurred OVFL 48 Overflow Output Indicates an ADC overflow condition is present Apenas para uso Interno da LGE 2 40 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de 5 704 PWM CONFIGURA O DO PIN OVERLOAD EPD ENA SO SDA SCK SCL DVDD DVSS 5 2 ADO CS I2C AD2 2 IO VSS XIN XOUT DMIX LRCK DMIX BCK DMIX SDOUT DVDD DVSS DMIX MCLK IO VDD IO VSS RESET TEST MODE1 TEST MODE2 SC
49. T3 15AL 250 3 15A 250V 058996 905 Ze 9 and 02 gt lt 1 o9 lt gt W930 w902 ge lt a a ONU lt 2 ZATTON Dose Or O 4 de 5 5648 p ili quim 12933 g Y He EM 1 ie aot Bo fofo jo jo SiS E IC931 c939 C933 C937 DS oe C934 TOF NA M Laan E E i o Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o A Pcsi2 an 5 cio 9 O pago 2 73 Goals ZD912 2999 3073 BUSY HT303 HT353 eS EAX39307803 c908 AS 5908 176X154 Ojojojos C905 2008 01 03 1 901 e 20901 5255 oo loo SS 2909 20592 Sono S169 ae 2 74 Apenas para uso Interno da LGE 3 DIAGRAMA DA PLACA DE TIMER 303 py sns SRR 05005009090 RRR 00900095009000900090 R347 Cn Xo lt gt IO 5 665666659 an 959 Ol ON o 22 EE
50. de treinamento e de manuten o COMO ATUALIZAR PROGRAMA AUDIO 4 PROGRAMA DVD 1 Como atualizar o programa AUDIO MICOM Atualiza o com o uso do CD 1 Mude o nome do arquivo para baixar como MODEL NAME Version HEX Apenas s o permitidas letras com caixa alta ex HT353 HT353_0709081 HEX 2 Copie arquivo para uma pasta raiz de um CD grave o 3 Insira CD no SET e mova para a fun o DVD A ent o o processo de atualiza o ir come ar com as informa es atualizadas 4 Quando terminar o processo de atualiza o o SET ser religado com a mensagem Complete Atualiza o com o uso do USB 1 Mude o nome do arquivo para baixar como MODEL NAME Version HEX Apenas s o permitidas letras com caixa alta ex HT353 HT353_0709081 HEX 2 Copie arquivo para uma pasta raiz de um dispositivo de armazenamento USB 3 Coloque USB no SET mova para a fun o USB Ent o o processo de atualiza o ir come ar com as informa es atualizadas 4 Quando terminar o processo de atualiza o o SET ser religado com a mensagem Complete 2 Como atualizar o programa DVD Atualiza o com o uso do CD 1 Renomeie o arquivo para baixar como TARGET BIN em letras de caixa alta 2 Copie o arquivo para a pasta UPGY do CD e grave o Ex PAMTK UPGITARGET BIN 3 Insira um CD no SET e ent o ap s alguns instantes a bandej
51. feixe de laser e n o deixe que entre em contato com os dedos ou outra parte do corpo 5 Limpeza da superf cie da lente Se houver p na superf cie da lente ele deve ser limpo com jato de ar como o usado para lentes de c mera lente segura por uma mola delicada Quando limpar a superf cie da lente portanto deve se usar uma haste de algod o tomando cuidado para n o deform la Press o Manta condutiva 6 Nunca tente desmontar o captador A mola pode se soltar com excesso de Se a lente estiver muito suja aplique lcool isoprop lico com a haste de algod o N o use outros limpadores l quidos porque eles podem danificar a lente Cuide para usar lcool demais na haste de algod o e n o permita que o lcool entre no captador Apenas para uso Interno da LGE 1 2 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o NOTAS SOBRE OS REPAROS NO CD PLAYER 1 Prepara o 1 Os CD Players incorporam um grande n mero de Cls assim como o captador diodo laser Esses compo nentes s o sens veis e facilmente afetados por eletricidade est tica Se essa eletricidade est tica tiver alta voltagem os componentes podem ser danificados e por este motivo os componentes devem ser manusea dos com cuidado 2 O captador composto de v rios componentes pticos e outros componentes de alta precis o Deve se ter c
52. o 2 o O e 96902000 97700 KARI O o 950 lo 029 o 2 609 9 00000 0 00050000 Ox ES o 20 do o 000000000 9 9 0 9 0 0 0 9 0 o 20 09 02 OO 0020500205000 O DOE Q0 0 O0 g o 92020202020 EP oo S 959200000 9 5255550 209 9 99 oo 00 00 2 02029 9 0 0 no S 5 o 50595050090 CEC 00000 229 gt 9 0 o 929 9000005 9995 916419 9 0 OOO OO OS 9944210 o o Goo 2 a e o o 0 94 16433 505 257 ox Oo 0000 016510 9 020 o 10 0000 o o 9 0 20 0 0 090 o oo 90092005 9 Xo 0 509 oo 5 8 gt Todos os direitos reservados Direitos autorais 2008 LG Electronics Inc Apenas para efeitos de treinamento e de manuten o 2 72 2 71 Apenas para uso Interno LGE 2 DIAGRAMA PLACA SMPS NOTAS Aviso Partes em cinza s o cr ticas com respeito ao risco de inc ndio ou choque el trico
53. o o 2 9 50509 X X o 14 x lt e S X o o 9 Front PRI ght 02000000 200000 o o o 22 O 2 o o o O o o di o o O KS 2020 Sue XO XO o on Ox 2 9 59299 20209090 9 9202050005 000 99 Left 920000 020005000009 2 0 072 SO OCO oY DLL 0000000000 9952229 99995020 Qu SC BO O OO O OO OO 090002 029 o o 5 0902020209090 0 ooo 0900090909090 2 9 9 9 9 ID DO gt pia AS 100000005090 Orriaz 0 50 5000 X 9 2 OKO 0000 X 29 X 9 0 0 SS COOK X oo 059 9 00000 O 929 C762 0205000900000 2 2 9 9 0 0 0 0 0 0 0 O 000 O50 O O O 0 O O 0 0 9 COCO O O O O O 202000 950770929 GO O GO 0 0 0 0 0 0 09 o oo o oo 95050 92 o o 2 ND 99299 o C 9 5 6 eje 2 9 9 2559 9 Sesto 00000000 000000000 0 5505020 o OD 0
54. 0 o 9 9 992929 0 0 0 0 0 0 SOS GND 9 o 0 Rear Left OO e Doo 9 9 9 9 9 2 229909 999 9909 7V WIRELESS GND Po 0060000 o E cA 9 9 oo g G9 DES Gud s ES Xo o o 13 0 0 GND 9 0 0 0 0 0 9 CES O 197 o o o 9 9000 5559 X OS X 070 XO N 00 0 090090900007 00989 0592 0000 X K o X 2020 2 9 X 29 o 9 9 09 9 9 9 9 9 9 0 9 9 9020 o Sub Woofer OX P o 59 2 9 9 000 OOOO 99 90 95 9 599 5 9 0000 lt 5566 gt Pes Pes O O O O 9 5929 929292929 oo v 09 o0 90009 gt 555 9 02020 9 09000 0000 oo o o 52 5559 000090 o o 229 o 99 9 O 020 9 9 0 0 0005090 00 99 029 OX 929 SON A 2 92992 0900 o o o 2 O 2 gt 2 OOO OOOO 2009 K Q OO OO O O o o 2 9 0505 lt 9 OO o 00007000 0 0070 O 90 0
55. 0 1 5s 1 00 Y 1 2 3 4 1 00 Y 5 s v 7 Hs ii 188 kS s DC 1 48 V 4 2 DC STOPPED FIG 10 1 DVD Direitos autorais 2008 LG Electronics Inc 2 21 Todos os direitos reservados Apenas para efeitos de treinamento de manuten o 8 813 88S m lt 888 s 025560 88985889 5578 2a 95 DACVDDC 95 vsrU GP1013 94 6 1042 33 PICKSELA 1 HsTR GPIO44 92 LR GPIO410 81 viga o 0 To 0 0018 o IC501 UD GPI09 e RID 5 88 7 87 Apenas para uso Interno LGE 18 Dec 82 04 17 lt lt lt lt X Ex Ex EX 11 SINAIS DE SA DA DE V DEO MT1389 L 1 Sinal de barra de cores completa COMPOSIT 2002 12 11 18 37 48 o 2 DC 1 48 V FIG 10 2 CD Normal SOMSag ZOHSfiv Stopped 42 10usAi Apenas para uso Interno da LGE Edge 0 500 Urdiv Auto 0 400 0 P P C4 2 42912 Freq C4 13 v14 14 REXT 8 16
56. 00000 202 A OO 02 SO o 925295970 lt o o e eS 9 0 OO OX o so o OO X OO o 9 Hee 100090 o p RAS 599595095060 2 o 9 0 0 d o 920 50 25 OOOO oo O 000 00 9999999 CO 0000 o oro e 0 0 00 9020 9 DO 005000 20 929205 29 050 9 205050 00 o RO 929 92020 T 9 52 299 9 9 0 9 SOS 39200 oo 9 o 9 A o o 9 o o ooo o o 9 0 X OO o o o 9 592920 29599595 o O 99 59 0 050 O O 050 99 Oo Oo 2000 0 0 0 o See eee 9 9 9 0 VOO COS 22 0 0 y 929 lt 9 9 9 0 Oo 9 9 9 9 0 A 0000 o 9 o o o 9 C o o o o QS o o OO 020 gt oo 92020 92 00 eu 90 292599 og o o o 5 0 lt lt 55590 Og 00 0 O O O O o 9 5 0 02070 92020202020 9999990 Oo OO OO 929295 52929290 OC 8 oo o OC o ok o 9209 9 9 9 CO
57. 100 8508 14 83 0 tuF a 002 gw REXT RAL vor 5 F SIBY 16 EEI me a s MT1389L M m 8 17 80 1001 BAL gt 0 18 79 7 ES E 1002 015518 m D 19 78 FE E AVDD33_2 BAO SA TROUT 20 77 4 29 25 O lur TROUTES Do TD TRIN m DMO Past E a E 55 P me m FMO cast cast 7 2 5 D 22 75 33 22 MAIO m TRAY OPEN er y EM 23 74 3 20 BAD Ser TRAY CLOSE AAA efle 9 24 73 1 37 18 omasi 6 To TRO RAS E DCAS 25 72 3 16 DE FOO RAG EM 26 71 14 EIN 6 6 2 42 NEI 007 43 12 27 sg pe RAB 70 m po DNF 44 be pum o 28 69 0010 5 10 005 SA A USB DM RAS L3 5 E TE 29 C535 0011 47 0 00 B 0 ur 004 5 E USB_V33 DVDD33 4 07 003 pA 30 87 Mn B 48 woo 5596 5 USB GND Sos four f Sys E Me 1 31 66 0014 51 4 001 DE io 5 1K PAD_VAT RCLK EY 47 ES SIS i UE t GND NC 32 Em 65 m zi 15 53 2 0 ur 000 88 DaMt Ses ut C505 C506 O xunnocourxzuanunur amp Esmnumsusozmuuncoceuznvsenozisgssgs 0 ur a 470 16 0 16 22883483939 h 5 55 5525 12504 SBE 5 b b b b a gee B 5 5 b b b 5 5 EMG3816515 66 4 Vig van 8 BS 9 SS S Bl Bl a 2 z 8
58. 6 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o 1 0 Description Option Port 7 VO 4 bit port No P70 to P73 I O specifiable in 1 bit units Pull up resistor can be turned on and off in 1 bit units Shared pins P70 INTO input HOLD reset input timer OL capture input watchdog timer output P71 INT1 input HOLD reset input timer OH capture input P72 INT2 input HOLD reset input timer 0 event input timer OL capture input high speed clock counter input P73 INT3 input with noise filter timer 0 event input timer OH capture input AD converter input port AN8 P70 AN9 P71 Interrupt acknowledge type Rising Falling kusing H level L level Falling INTO enable enable disable enable enable INT1 enable enable disable enable enable INT2 enable enable enable disable disable INT3 enable enable enable disable disable Port 8 1 0 7 bit I O port No P80 to P86 I O specifiable in 1 bit units Shared pins AD converter input port ANO P80 to AN6 P86 PWM2 1 0 PWM2 and PWM3 output ports No PWM3 General purpose I O available Port 3 1 0 8 bit I O port Yes P30 to P37 I O specifiable in 1 bit units Pull up resistor can be turned on and off in 1 bit units Pin functions P32 UART1 transmit P33 UART1 receive P34 UART2 transmit P35 UART2 re
59. 6 216 216 6 le le 5 6 gt gt 6 xm UNLESS OTHERWISE SPECIFIED A DA RR 4 A B E F G H K L M Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o 2 58 AUX L coss T 121 C236 8 102041 AUX R T 102111 AULA L ch O LU 95 A x O R ch R 14 SCART OPTION P FS ELE y zoztifzo s iB 3 20210 ONLY RCA USED HT303 HT353 0 07 11 23 EBY38558901 4 2007 11 30 Apenas para uso Interno da LGE 6 DIAGRAMA DO CIRCUITO 12 SPAM Modulstion AMP SECTION quer
60. 703 2 10 Verificar entre IC704 BCK LRCK ADATAO Verificar o circuito relacionado a PWM Verificar sa da de udio Pinos 55 59 61 62 68 71 75 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o 6 PROTECTION aparece FLD sm Ap s ter desconectado cabo de for a conecte o outra vez E Ligar sm PROTECTION Aparece continuamente no FLD OK Est o sinal do 101 pin54 sm Est o os Q701 e Q702 Substituir o Q701 e Q702 normais sm Substituir ST 702 703 Direitos autorais 2008 LG Electronics Inc 2 11 Apenas para uso Interno LGE Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o 7 CIRCUITO p COM DE UDIO DVD E AMPLIFICADOR C CD DVD FLD no Disc t sem disco ou a hora cl FLD Verificar Micom est o Verificar alimenta o Verificar M dulo DVD SIM Verificar SMPS Apenas para uso Interno da LGE Aparece DVD Error erro no DVD alimentac o do B D principa Verificar se o Pino 5 de IC10 Verificar se os Pinos 9 36 e 59
61. 8 E do I n e els 5 gls g X BTS BTI lt For MPEG amp SERVO 2 v20 To 4 0503 quis 0 VAP C502 Ts O tF lop 2 sa el al al amp ol z al al als s sssss sss 8888 8888 1 B C D H J K M N Apenas para uso Interno LGE 2 51 2 52 MICOM PART PART AMP PART HT353 MPEG PART 07 11 23 1 EBY3855890 1 2007 11 30 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o 3 DIAGRAMA DO CIRCUITO SERVO 12 11 10
62. AN ENA TEST MODE3 zi a a a z 2 a a 8 a 2 a E a a a a 2i E ASE Qo 0 ox Go 1D D o x od sd omo Bon 76 50 77 49 78 48 79 47 80 46 81 45 82 44 83 43 84 42 85 41 86 40 87 39 88 38 89 37 90 36 91 35 92 34 93 33 94 32 95 31 96 30 97 29 98 28 99 27 100 26 uos oonoo ENL L2 ELJARAS 88988 S 2 5 PD 2 2300338 gd e DIAGRAMA DE BLOCOS Serial Audio Output interface MBCK MLRCK Input MSDIN 0 3 amp Output SBCK SLRCK SSDIN 0 3 Sample Rate Converter MCLK MIC Input MIC_LRCK MIG_SDIN Processor SPI I2C SO SDA SCK SCL SII2C_AD0 CS I2C AD2 EXT MUTE Bass Manager Automatic Gain Limiter Internal Controls Internal Clock Internal Reset Reset amp Power Down Crystal Oscillator XIN Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o RESET 2 41 Power Supply PLL_DVDD PLL_DVSS PLL_AVDD PLL AVSS DVDD DVSS IO VDD IO 55 Output Mapper IO VSS PWM1_P PWM1_M IO_VDD PWM HP LP PWM HP
63. CASIONALMENTE DIFERIR DO CIRCUITO USADO DE FATO DESSA FORMA A DAS ULTIMAS 1 5 s o essenciais para segu ran a Reponha apenas com n mero espec fico de pe a 2 As voltagens s o medidas por corrente direta com 1 MUDAN AS DE MELHORIA PARA SEGURAN A E voltimetro digital durante o modo Play DEVER O SER SUBSTITUIDOS SOMENTE POR PERFORMANCE DENTRO DO SISTEMA N O ESTA 12 TIPOS IDENTICOS AQUELES NO CIRCUITO ORIGI DEFASADA ATE QUE A NOVA LITERATURA DE NAL OS COMPONENTES ESPECIAIS ESTAO SOM SERVI O SEJA IMPRESSA BREADOS CIRCUITO ELETRICO PARA FACILI I A IDENTIFICA O 0931 De I Y I 85 4 R934
64. E 2 63 2 64 31 KEY SYMBOL No LH T9656 50301 STAN BY SW302 sk1p SEARCHH PRESET 51303 SkIP SEARCH PRESET SW304 STOP 54305 PAUSE MONO STEREO 5 305 PLAY 547 opEN CLOSE R FRONT HT303 2007 07 16 EBY39798401 2007 11 30 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o 9 DIAGRAMA DO CIRCUITO PWR TECLAS CN30 1 54301 PRR KEY 2 JGND 3 j 717 5 3 PWR KEY HT303 2007 06 27 EBY39799101 01 2007 11 30 B C D E F G H I J K L M N Q R 5 T Direitos autorais 2008 LG Electronics Inc 2 65 2 66 Apenas para uso Interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento e de 10 DIAGRAMA DO CIRCUITO DO amp USB amp PTB 12 gt ala 15K 3H e C2D1 R203 K203 220U 6 3V 11 USB JAC
65. IO11 GPIO10 DVDD18 GPIO9 GPIO8 GPIO7 CKE RA3 RA2 DVDD33 RA1 RAO RA10 BA1 DVSS18 BAO RAS CAS RWE RA4 RA5 RA6 RA7 RA8 RA9 DVDD33 RA11 RCLK DQM1 Apenas para uso Interno da LGE DIAGRAMA DE 5 CVBS Da Com onent Module TV Encoder Video RF Amplifier Video Servo IO Motor Servo Drive Processor Video De gt Processo interlacer Spindle Control FLASH MPEG 1 2 4 ROMI JPEG Memory Controller Video Decoder Internal 6ch Audio DACs 6ch Audio Analog us outputs System butput Audio Parser Audio DAC Ouptut SDPIF GPIO Audio Audio Mic2 Internal IR VFD Audio ADC USB 2 0 High USB 2 0 High Speed Full Speed controller Device MS SD MMC Card MS SD MMC Controller Flash Card 2 26 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para uso Interno da LGE Apenas para efeitos de treinamento e de manuten o DESCRI O DO PIN Abbreviations SR Slew Rate PU Pull Up PD Pull Down SMT Schmitt Trigger 4mA 16mA Output buffer driving strength Main RFIP Type Analog nterface 66 Analog Input Description AC coupled DVD RF signal input RFIP
66. K DGND 10 9 L E1 BEAD 4 7 50 4K rm Er 6203 09 gtx GND a w JK2D4 4 9 Ad 8 PN202 x 8 8 L206 rev T W 1 hus GND L207 re T W 2 D 4 L2E2 De 7 BEAD 4 7 80 47K 1209 5 E Er AW CAD 6 PTB L 5 8 204 215 7 AGND ere ys 1208 M 8 END w BEAD 49 5 AGND _ OO a oa Sea wee o eee eee 10 MIC4 6 OPTION2 I 1 m MIC2 i i 4 1203 12 MIC DET CFIOGBF gt 3 4 Es 7 all GND 5 8 La 1204 i CF 1068F 7 m I Anita OPTION4 GND 5 4 s W 5 p Pence cnn P 1205 CF 1068F 2 T dE i e GND 3 8 A Ls i m Eu 2 IC USB PTB HT303 2007 06 27 3Y39799201 1 D E F G H M N O 5 Apenas para uso Interno LGE 2 67 2 68 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o DIAGRAMAS DAS PLACAS CIRCUITO IMPRESSO 1 DIAGRAMA DA PLACA PRINCIPAL P C VISTA SUPERIOR
67. LM IO VSS DVSS DVDD PWM RP PWM HP RM IO VDD IO VSS PWM SWL P PWM SWL M DVSS DVDD MIC SDIN MIC LRCK BCK MCLK IO VDD Io VSS EXT MUTE SSDIN3 Serial Audio Output interface PWM Modulator Apenas para uso Interno da LGE DMIX MCLK OLRCK OBCK DMIX SDOUT PWM1 P M PWM2 P M PWM3 P M PWM4 P M PWMS5 P M PWM6 P M PWM7 P M PWM8 P M PWM HP L P M PWM HP R PM PWM SWL P M EPD ENA OVERLOAD DESCRI O DO PIN Name Pin NO Type Description Power and Ground PLL_AVDD Analog Power PLL analog power supply PLL_AVSS Analog Ground PLL analog ground PLL_DVDD PLL Power PLL digital power supply PLL_DVSS PLL Ground PLL digital ground DVDD 13 34 42 66 80 91 Power Core power supply DVSS 14 35 43 63 81 92 Ground Core digital ground IO_VDD 4 10 22 29 39 47 56 65 72 94 Power power supply 3 3V Digital power supply RESET 1 5 7 9 21 28 38 44 50 53 57 60 64 69 73 85 95 digital ground Reset and Clock H W reset signal Active Low Schmitt Trigger input The Schmitt Trigger input allows a slowly rising input to reset the chip reliably The RESET signal must be ass
68. MOTA VR CD 10401 9 CD VR 23 8 18 23 e GND AM5890S jk 9 C401 FOSO 1 28 STBY T VINFC 0 tur gt 96 2 mg BIAS 21 3 26 TRSO GND GND R415 REGO 2 nene neo ms meo Z 10K 40K M 5 4 a CN401 d E e e 110430 LOAD TROPEN 8 B sp mo LE DMSO 15431 LOAD TRCLOSE La dd 22 2 TROUT OPEN E 15432 4 35 M E pazo CLOSE 4 5433 4 wee GND e 1 kad 8 21 8421 OPEN END 71664 GB GND AMEN o 3 6 s t Lost a et 20 FM 15427 vorn veo FM 7 15428 S NOD VOTRF Vcc2 do Sr 8 15425 act 14 18 sp R405 SP A SL 12 17 SP SP 9 16424 W vosL VOLD 1 2042 F 13 ELS oT 16 mos F 14 15 Tt 10K VOFCK VOTK R401 tz 7 10K Sa 0404 5 5 5 2 opt GND 50 23 NBA 5 STS B H J K L M Direitos autorais 92008 LG Electronics Inc Todos os direitos reservados a Apenas para efeitos de treinamento e de manutenc o FOSO Foso TRSO lt J FMS0 50 0 50 lt pMso TROPEN lt TROPEN TRCL0SE lt J TACLOSE oP lt op opt o V1P4 lt J vips v20 lt 1001 lt 1004 1002 lt J Lpo2 C 10 STBY stay D gt gt D E gt E F LD
69. NAO SUBSTITUA R345 R350 VERIFIQUE O CIRCUITO RM Apenas para uso Interno da LGE 4 FLUXO DO SISTEMA Co o 1 Initializes SERVO DSP amp RISC registers 2 Escrever o c digo RISC na SDRAM 3 Restabelecer RISC Mostrar LOGO SIM Bandeja fechada Bandeja se fecha para posi o Fechada SIM SLED do lado interno SLED se move para posi o interna 2 Passar para o procedimento de leitura de disco correspondente 1 Julgar se h disco e seu tipo Receber tecla de Abre Fecha 1 Executar tecla pressionada e a tecla IR 2 Loop da rotina de opera o do sistema r 1 Parar abrir bandeja 2 Exibir mensagem de Bandeja Aberta e LOGO Receber tecla CLOSE Apenas para uso Interno da LGE 2 4 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o 5 FLUXO DE TESTE E DEPURA O C 5 SIM Verifique a de alimenta o 110V 220V Verificar a alimenta o SIM Ativar a PCBA de alimenta o sm As sa das DC est o normais 12V 5 6V 3 5V 5V 7V 34V Verificar a alimentagao SIM As saidas de 3 5V e 5V DC est o norma
70. O o lt D s 5 2550 8835 8 89 25 2855 54885 R88 SSS 58 5 58 5259959 55538522138254565 gt 595 25883839045 2 lt lt lt lt o gt O 3 w OO n b a Q Q Bud 2428 83 8 amp 5 5 5 5 8 IC501 zi Q cg Apenas para uso Interno da LGE 8 SINAIS DE FOCO LIGADO 18 Dec 02 0 29 08 4 1 dE 878 5s E 1 00 Y 1 4 18181888 8 ka lt 88982 88589 o G o 8 5 95 5 VREF DACVDDC zo vstu ep1013 94 spoir eProte 33 ICKSELA 1 HsTR GPI044 92 LR P1040 8 yan 70 no 90 1 C537 501 DVDD18 de uf UD GP108 89 RO i 5 88 7 87 ADDATA 5 5 v 10 180 kS s 1 V Og 2 DC 1 48 V 4 2 V DC O STOPPED FIG 8 1 DVD MDI1 MDI2 1001 1002 E 0804 AVDD33 2 E DMO Po MT 13589 TRAY OPEN TRAY CLOSE TRO Foo FG GPIO2 USB_DP USB_DM USB_V33 USB_GND 10 0 02 0 28 35 1 i 16 17 02 18 19
71. R SPP a o a EU T D D Qd gen Race 8337 Rasa mE Dec DE 79999050260 70638105 4 DIAGRAMA DA PLACA DE TECLAS HT303 sn PWR KI 10640 mm 5 DIAGRAMA DA PLACA FRONTAL JACK 2203 JK2D2 CHAIN d o oo 959020 5 02050 99 Qs VEN A CX 5205559 OOO o 0050 9090000 DO OO OO Na 09000900 A PORO A RRR O 050500900 L209 OOO PON IN 00 0 9 0 0 9202020 ese ge o LS 0 0 48 0 0 040 0 3 e o IS IA O 1298 207 p 1206 On DCN CC ORO LS 267 000000 MMMM IAS AS 20209050 FRONT JACK JK2pu 10959950500 9820202020202000 oo o o o 2025220 O o O O 0 0 0 C x M FELT ELE loooo 020505050 9 9 020 00020200 20 0 020 0 0 0 0 0 020 0 05 7 0 020 02050 000 9 99 0505000000 OOOO OOO RII IRI OQ 000202050 10507040 OC 0 0 0 0 0 0 0 0 0 0 0 0 0 0 040 559 955220 0000 070 95000 920 92020202020 00 0 00 O O O O O 0 O O O O O 00 O O O O O O O O 0 0 00 00 00 00 O O O O O O O OS o Apenas para uso Interno da LGE 0303
72. S X o o KIO 0 070 99 R o CR 0 09 9 0 0 10000500000 oo 2 o o gt 2 0 oco o 999 929 999 275 o E 929 209 o 0000 040 2009 o 9 0 X o 000 0 0000 OO 2 e o A No 0 0 05000 0 0 CX 29 gt 0 0 9 2 000 o DOS o 92929 27 00090909050 97 292929 50500950000 0000 ODIO 5 VS 29 929 9 do O o ph A A o o 0 0 0 o 0 0 0 0 00000 CA 6969 920 O 00000 XX 99 AC X CO 5000 or o 1 09 o 929 o 5 o9 o OO o 5 SS 299 5 000000 OS 22050500 909090 80 229 229 OO 0000 Xo 99 e 2 29 9 SOC lt 229 3164680 29 99 5959 2076806 O JIG695 pm 960 O 950016407 21640802090 SO a o 2 e X 16415 go c ae eO 900 lt 202 90505 929 0 PEGO 79 x 5 20
73. SD_CLK set A 4 ASDATA2 5 ACLK Apenas para uso Interno da LGE 2 30 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de Description Audio Mute 7 8 1 SOS 2 MS DO set A 3 SD CMD set A 4 ASDATA1 5 L 7 1 2 6 C C E GPIO10 SD CLK set B 3 SD DO set A 4 ASDATAO 5 ALRCK 6 output C C GPIO10 8 ru 1 GPIO11 2 SD set B 3 MS BS set B GPIO11 8 4 Audio Mute 5 output 1 SEDI output 2 GPIO12 1 GPIO13 2 SD DO set B GPIO13 E 3 ALRCK 4 Audio Mute 5 YUVCLK GPIO12 Direitos autorais 2008 LG Electronics Inc 2 31 Apenas para uso Interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o 2 IC401 MOTOR DRIVER CONFIGURA O DO PIN
74. V n FIG 6 1 Direitos autorais 92008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o 100 kS s STOPPED 188 kS s STOPPED 0 1l C50 VIBA 4 C516 470 46 GN F506 5 1K AW D TE m C505 470 16 C506 0 10 1002 AV0D33 2 DMO FMO TRAY OPEN TRAY CLOSE TRO FOO FG GPIO2 USB_DP USB_DM USB_V33 USB_GND PAD_VAT USB V1B GPIO3 INTE TELS MT 388 GPI04 62106 SF_CS_ SF_DO SF DI AGND33 veo 14 MDI1 MDI2 1001 0033 2 DMO FMO TRAY OPEN TRAY CLOSE TRO F00 FG GPIO2 DISCO IESO MT 1389 Apenas para uso Interno da LGE 7 SINAIS DE RECONHECIMENTO DE TIPO DE DISCO 18 Dec H2 Reading Floppy Disk Drive B 12 56 1
75. Website http biz lgservice com LG RECEPTOR DVD CD LG AVS NSEEH MODELO HT303SU A2 SH33SU S W P NO AFN37064409 FEBRUARY 2008 NDICE 1 O SEC O 1 GENERAL e PRECAU ES DE MANUTEN O e PRECAU ES ESD INFORMA ES PARA MANUTEN O DE EEPROM COMO ATUALIZAR O PROGRAMA AUDIO MICOM amp O PROGRAMA DVD ESPECIFICA ES 2 2 O SECTION 2 SE O DA PARTE EL TRICA GUIA PARA SOLU O DE PROBLEMAS DETALHES E SINAIS DO TESTE DE SISTEMA E DEPURA O DIAGRAMA DE BLOCO INTERNO DOS ICs DIAGRAMA DE FIA O e DIAGRAMA DE BLOCOS 1 4 DIAGRAMAS DE CIRCUITO maqa s saam en e DIAGRAMAS DAS PLACAS DE CIRCUITO 55 3 VISTAS EXPLODIDAS SE O DO GABINETE E ESTRUTURA CENTRAL e VISTA EXPLODIDA DO MECANISMO DO DECK DP 12TV e SE O DE ACESS RIOS ALTO FALANTE
76. a do CD ir se abrir com a informa o j atualizada na tela 4 Remova o CD e pressione a tecla UP no controle remoto 5 Remova e reconecte o cabo de energia quando ele mudar para a tela com o logo das informa es atualizadas Assim o processo de atualiza o est completo Atualiza o com o uso do USB 1 Mude o nome do arquivo para baixar como TARGET BIN em letras de caixa alta 2 Copie o arquivo para a pasta UPG V do USB formatado e grave o Ex PAMTK UPGITARGET BIN 3 Mova para a fun o USB e insira o USB no SET A informa o atualizada ser exibida na tela 4 Remova o USB e pressione a tecla UP no controle remoto 5 Remova e reconecte o cabo de energia quando ele mudar para a tela com o logo das informa es atualizadas Assim o processo de atualiza o est completo Direitos autorais 2008 LG Electronics Inc 1 7 Apenas para uso Interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o ESPECIFICA ES GERAIS For a El trica Referir se ao s lo principal Consumo de energia Referir se ao s lo principal Peso l quido 3 6 kg Dimens es externas W x H x D 430 x 70 x 311 mm Condi es de opera o Temperatura 5 C to 35 C Condi o operacional Horizontal Umidade operacional De 5 at 85 AMPLIFICADOR Modo Surround Frontal 45W 45W Pot ncia de Sa da 30W THD 10 do modo de som da onte pode Central 45W ican Sur
77. a efeitos de treinamento e de manuten o 2 8 Foco ligado Track ligado Sinais NAO Verificar as conex es entre o MT1389 L e o cabe ote do captador MT1389 L Sinal CD DCDCT adequado em MT1389 L NAO Verificar circuito relacionado em MT1389 L CD DVDCT Verificar CD DVDCT entre AM5890 MT1389 L Proper CD DVDCT signal on MT1389 L NAO Verificar circuito relacionado em MT1389 L Verifique a conex o TRACK em on MT1389 L e no driver do motor Sinal TRACK NAO adequado MT1389 L NAO Verificar o circuito de controle Ny de tracking do amplificador no driver do motor e TR tem saida adequada SIM Verificar a conexao do cabo cabe ote do captador NAO Disco toca Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Verificar o sinal RF x Apenas para uso Interno da LGE 2 9 Apenas para efeitos de treinamento e de manuten o Sa da normal de udio quando o disco reproduzido NAO DO TESTE Apenas para uso Interno LGE PWM IC receb fluxo correto de dados Sa da normal de PWM IC IC704 NAO NAO Verificar circuito de amplifi cador digital 702
78. ceive Port C 1 0 8 bit I O port Yes PCO to I O specifiable in 1 bit units Pull up resistor can be turned on and off in 1 bit units Pin functions PC5 to PC7 On chip Debugger RES Input Resetpin No XT1 Input 32 768kHz crystal oscillator input pin No Shared pins General purpose input port AD converter input port AN10 Must be connected to Vpp1 if not to be used XT2 1 0 32 768kHz crystal oscillator output pin No Shared pins General purpose port AD converter input port AN11 Must be set for oscillation and kept open if not to be used CF1 Input Ceramic resonator input pin No CF2 Output Ceramic resonator output pin No Direitos autorais 2008 LG Electronics Inc 2 37 Apenas para uso Interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento de manuten o 4 12201 ADC CS5345 CONFIGURA O DO PIN J Q X 5 48 47 46 45 44 43 42 41 40 39 38 37 SDA CDOUT 1 36 VLS SCL CCLK 2 35 TSTO ADO CS 3 34 NC AD1 CDIN 4 33 NC 5 32 AGND 6 CS5345 31 1 AGND 7 30 VA AINSB 8 29 PGAOUTB AIN2A 9 28 PGAOUTA AIN2B 10 27
79. e de manuten o 3 4 3 3 Apenas para uso Interno da LGE SE O DE ACESS RIOS CABO PORTATIL DA ENTRADA PILHAS ANTENA CIRCULAR AM CONTROLE REMOTO ANTENA FM CONJUNTO DE INSTRU ES be 2 ADAPTADOR EMBALAGEM CARCA A EMBALAGEM CARCA A Direitos autorais 2008 LG Electronics Inc 3 5 Apenas para uso Interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o ALTO FALANTE 1 ALTO FALANTE FRONTAL CENTRAL TRASEIRO SH33SU S F L SPK FRSPK ______________________________________________ 82 CENTER SPK R L SPK FA R R SPK F R SPK CENTER SPK R L SPK R R SPK Apenas para uso Interno da LGE 3 6 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o 2 SUBWOOFER PASSIVO SH33SU W 950 fo Direitos autorais 2008 LG Electronics Inc 3 7 Apenas para uso Interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o ANOTA ES Apenas para uso Interno da LGE 3 8 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o SE O 4 MECANISMO DP 12TV NDICE LOCALIZANDO PE AS DO MECANISMO DO DECK e VISTA DO ALTO
80. eC 3 Em 1 Audio ADC input 1 2 MS DO set B 3 Audio Mute 4 2 output 5 1 C 6 AADVDD Power 3 3V power pin for 2ch audio ADC circuitry APLLVDD3 Power 3 3V Power pin for audio clock circuitry APLLCAP Analog InOut APLL external capacitance connection ADACVSS2 Ground Ground pin for audio DAC circuitry ADACVSS1 ARF LFE Ground Analog Output Ground pin for audio DAC circuitry 1 Audio DAC sub woofer channel output 2 While internal audio DAC not used a ACLK b GPIO Analog Output 1 Audio DAC right Surround channel output 2 While internal audio DAC not used b GPIO Analog Output 1 Audio DAC right channel output 2 While internal audio DAC not used a SDATA2 b GPIO c RXD2 Analog Audio DAC reference voltage Analog Output 1 Audio DAC left channel output 2 While internal audio DAC not used a SDATA1 b GPIO c RXD1 Analog Output 1 Audio DAC left Surround channel output 2 While internal audio DAC not used a ALRCK b GPIO ALF CENTER Analog Output 1 Audio DAC center channel output 2 While internal audio DAC not used a ASDATA0 b GPIO ADACVDD1 Analog Power 3 3V power pin for audio DAC circuitry ADACVDD2 Analog Power 3 3V power pin for audio DAC circuitry AVDD18 1 Analog Power Analog 1 8V power
81. egative PWM output of channel 5 Positive PWM output of channel 6 Negative PWM output of channel 6 Positive PWM output of channel 7 Negative PWM output of channel 7 Positive PWM output of channel 8 Negative PWM output of channel 8 Positive PWM output of headphone left channel Negative PWM output of headphone left channel Positive PWM output of headphone right channel Negative PWM output of headphone right channel Positive PWM output of subwoofer line output Direitos autorais 2008 LG Electronics Inc 2 43 Apenas para uso Interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o SCK for SPI mode or SCL for 2 mode Schmitt Trigger input CS I2C AD2 SCK SCL 79 2 ADO 82 EXT MUTE SI for SPI mode or Slave Address 0 for I2C mode Schmitt Trigger input Internal pull down resistor Chip selector CS for SPI mode or Slave Address 2 for 2 mode Schmitt Trigger input Internal pull down resistor Special Control Interface External mute control input Active High Assert HIGH to mute audio output Internal pull down resistor OVERLOAD Power stage overload indication input Polarity is programmable Schmitt Trigger input When OVERLOAD is asserted all PWM audio outputs go to LOW That shutdown p
82. erted Low during power up De assert High for normal operation Crystal Oscillator input pin Crystal Oscillator output pin PCM Audio Input Output Interface PCM bit clock input output of main 8 channel audio User can select the master slave mode of this signal Schmitt Trigger input PCM Word clock left right clock input output of main 8 channel audio User can select the master slave mode of this signal Schmitt Trigger input MSDIN 3 0 15 16 17 18 serial data input of main 8 audio Schmitt Trigger input SBCK 19 PCM bit clock input output of 8 channel audio User can select the master slave mode of this signal Schmitt Trigger input PCM word clock left right clock input output of sub 8 channel audio User can select the master slave mode of this signal Schmitt Trigger input SSDIN 3 0 23 24 25 26 Apenas para uso Interno da LGE PCM serial data input of sub channel audio User can set this sub channel data input pins to PCM serial data output pins See the Control Register Description part Schmitt Trigger input 2 42 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o MCLK Main clock external microphone input A DC Clock frequency be selected between 6 144 2 12 288 2 and 24 576MHz MIC_BCK PCM bit clock input output of external m
83. est er Ss sola t Ela a 315 3 la 8 11 Len SI Ss bres 878 8 RO 1504 A I 1 DO a user CI USBN 1 2 se sala 2 5 amp s aa a al da ua SS sis e 2 38 oO X O 0 nm on co du m o 22 589 18B8B889888858592898588252538 BERE 22852 5488 5 828 5 596 7e gt cves 259 82 8835 88545340545 1 mw 8 1 2 lt lt lt lt lt lt lt 5 96 Das 10 3 333 VREF 8 5 ERA o EN 95 AFB D E 8 DACVDDC ss I 10503 lt 5 2 3 pec lt a vstu epio13 94 vo 4 3 8 sPo1F GP1012 23 proxseLs seno eru n Eee x xa W E 5 pre x x HSTR GPI044 82 88 my petje sa to 8 SERVO oer LR GPIO40 91 e 1X0 no PART 7 90 0537 9 i AVDD18_2 00018 nima PICKSEL L B 89 c rm 8 A 00334 UD GPIOS e Bo Dick Foso REOS 100K 9 88 850 XTALI VSTD GPIOB TROPEN Ux FSO 10 87 gt ADDATA e Den XTALO GPIO7 CKE ae lt gt DADATAO TROPEN o oq 86 Ma OMA DADATAL TACLOSE E DADATA2 P La 12 85 me 8 no OP v20 RA2 43 B4 C536 oe va C501 oe 88 1
84. facilmente pela eletricidade est ti ca Esses componentes s o normalmente chamados de Dispositivos Eletrostaticamente Sens veis ESD Exemplos dispositivos ESD t picos os circuitos integrados e alguns transistores de efeito de campo e com ponentes de chip semicondutores As seguintes t cnicas devem ser usadas para ajudar a reduzir a incid ncia de danos a componentes causados por eletricidade est tica 1 Imediatamente antes de manusear qualquer componente semicondutor ou conjunto equipado com semicon dutor libere eletricidade est tica de seu corpo tocando em um aterramento conhecido Outra op o usar uma pulseira de descarga dispon vel comercialmente que deve ser removida antes de ligar o aparelho em teste por causa do perigo potencial de choques 2 Ap s remover um conjunto el trico equipado com dispositivos ESD coloque o conjunto em uma superf cie con dutiva como uma folha de alum nio para evitar o ac mulo de carga eletrost tica ou a exposi o do conjunto 3 Use apenas um ferro de solda de ponta aterrada para aplicar ou remover solda de dispositivos ESD 4 Use apenas dispositivos de remo o de solda anti est ticos Alguns dispositivos de remo o de solda n o classificados como antiest ticos podem gerar cargas el tricas suficientes para danificar dispositivos ESD 5 N o use produtos qu micos que tenham freon como propelente Eles podem gerar cargas el tricas suficientes para danif
85. ga normal Sinal de TROPEN e TRCLOSE normal NAO Verificar os pinos IO de controle da bandeja em MT1389 L Sinal NAO verificar o circuito amplificador da Bandeja IC401 LOAD e LOAD normal Verificar a conex o do cabo entre o PCAB principal e o carregador MECHA 2 6 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o Verificar linha de DRV MUTE Verificar o circuito relacionado a SLEGN SLED NAO e para a posi o inter 4 quando est em posi o externa DRV_MUTE drive do motor est alto SLED e NAO SLED tem sa da adequada Verificar o circuito do AMP no driver do motor Verifique a conex o do cabo com MECHA N o colocar o disco e fechar a bandeja H sa da de Foco adequado para o driver do motor NAO 2 lente ptica tem movimentos para buscar o foco SIM H sa da NAO adequada F e F Verificar a conex o do cabo com o cabe ote do captador Direitos autorais 92008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o Verificar a conex o do Foco em MT1389 L e no drive
86. icar dispositivos ESD 6 N o remova um dispositivo ESD de reposi o de sua embalagem protetora at imediatamente antes de estar pronto para instal lo A maioria dos dispositivos ESD embalada com condutores unidos eletricamente com circuito fechado por espuma condutiva folha de alum nio ou materiais condutivos similares 7 Imediatamente antes de remover o material de prote o dos condutores de um dispositivo ESD de reposi o toque no material de prote o do chassis ou do conjunto de circuito no qual o dispositivo ser instalado CUIDADO ASSEGURE SE DE N O HAVER ENERGIA NO CHASSIS OU CIRCUITO E OBSERVE TODAS AS OUTRAS PRECAU ES DE SEGURAN A 8 Minimize os movimentos do corpo quando estiver manuseando dispositivos ESD de reposi o fora da embal agem Caso contr rio movimentos inofensivos como a fric o do tecido de suas roupas ou o levantar de seu p de um piso acarpetado podem gerar eletricidade est tica suficiente para danificar um dispositivo ESD CUIDADO S MBOLOS GR FICOS O S MBOLO DE RAIO COM SETA DENTRO DE UM TRI NGULO EQUIL TERO ALERTA O PESSOAL DE MANUTEN O PARA A PRESEN A DE VOLTAGEM PERIGOSA N O ISOLADA QUE PODE SER FORTE O SUFICIENTE PARA CONSTITUIR UM RISCO DE CHOQUE ELETRICO O PONTO DE EXCLAMA O DENTRO DE UM TRI NGULO EQUIL TERO SERVE PARA ALERTAR O PESSOAL TECNICO SOBRE A PRESEN A DE INSTRU ES DE SEGURAN A IMPORTANTES NA LIT ERATURA DE MANUTEN O Apenas
87. icrophone Bit clock frequency is 3 072MHz 48 2 x 64 fixed MIC_LRCK PCM Word clock left right clock input output of external microphone Word clock rate is 48kHz fixed MIC SDIN PCM serial data input of external microphone Schmitt Trigger input DMIX MCLK Main clock for external down mix line output D AC DMIX BCK PCM bit clock output of down mix signal Bit clock frequency is 6 144 2 96kHz x 64 fixed DMIX LRCK PCM Word clock left right clock output of down mix signal Word clock rate is 96kHz fixed DMIX SDOUT PCM serial data output of down mix signal PWM Audio Output PWM1_P Positive PWM output of channel 1 PWM1_M PWM2_P PWM2_M PWM3_P PWM3_M PWM4 P PWM4 M PWM5 P PWM5 PWM6 P PWM6 M PWM7_P PWM7_M PWMB8 P PWMB8 M PWM HP L P PWM HP L M PWM HP RP PWM HP RM PWM SWL P PWM SWLM Negative PWM output of subwoofer line output System Control Interface SPI I2C 84 Host interface mode SPI 120 selector Assert HIGH for SPI mode De assert LOW for 2 mode Internal pull down resistor SO SDA 78 SO for SPI mode or SDA 2 mode Negative PWM output of channel 1 Positive PWM output of channel 2 Negative PWM output of channel 2 Positive PWM output of channel 3 Negative PWM output of channel 3 Positive PWM output of channel 4 Negative PWM output of channel 4 Positive PWM output of channel 5 N
88. imer 7 toggle output Yes Port 1 P10 to P17 8 bit I O port I O specifiable in 1 bit units Pull up resistor can be turned on and off in 1 bit units Pin functions P10 SIO0 data output P11 SIO0 data input bus 12 5100 clock I O P13 SIO1 data output P14 SIO1 data input bus P15 5101 clock I O P16 Timer 1 PWML output P17 Timer 1 PWMH output beeper output Yes Port 2 P20 to P27 8 bit I O port I O specifiable in 1 bit units Pull up resistor can be turned on and off in 1 bit units Other functions P20 INT4 input HOLD reset input timer 1 event input timer OL capture input timer OH capture input INT6 input timer OL capture 1 input P21 to P23 INT4 input HOLD reset input timer 1 event OL capture input timer OH capture input P24 INT5 input HOLD reset input timer 1 event input timer OL capture input timer OH capture input INT7 input timer OH capture 1 input P25 to P27 INT5 input HOLD reset input timer 1 event input timer OL capture input timer OH capture input Interrupt acknowledge type Yes Rising Rising Falling Falling H level L level INT4 5 6 INT7 enable enable enable enable enable enable enable enable enable enable enable enable disable disable disable disable disable disable disable disable Apenas para uso Interno da LGE 2 3
89. is na PCBA principal Verificar os reguladores ou o diodo sm FLASH atualizada com sucesso NAO NAO NAO NAO SIM 1 Verificar o clock do sistema de 27 2 2 Verificar os circuitos de reset do sistema 3 Verificar o sinal de habilitar Flash R W PRD RWR 4 Verificar o circuito relacionado com a mem ria FLASH NAO Substituir a FLASH Direitos autorais 2008 LG Electronics Inc 2 5 Todos os direitos reservados Apenas para efeitos de treinamento de manuten o Apenas para uso Interno da LGE SIM Ligar Mostra LOGO A bandeja se move para dentro quando n o est na posi o echada SIM Apenas para uso Interno da LGE Verificar as linhas de conex o entre a FLASH e MT1389 L e se o tempo de acesso da FLASH adequado ou n o A mem ria Flash opera adequadamente NAO NAO Verificar as linhas de conex o entre SDRAM 504 MT1389 L e se a SDRAM n o est danificada NAO SDRAM opera adequadamente VIDEO MT1389 L tem sa da adequada NAO Verificar os circuitos relativos gt de MT1389 L 501 Pinos 99 102 103 104 SIM Verificar a conex o do Cabo AV com o aparelho de TV NAO Sinal de gt lt OPEN SW CLOSE SW verificar o interruptor de OPEN amp CLOSE de car
90. itos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o 5 DIAGRAMA DO CIRCUITO DE 5 lt lt 1 O SECTION 12 VCC33 8 LACK i ADDATA 11 E a E S E 10 S830 5345 TUNER_DAT 4 9830 5345 TUNER CLK 2 3 0 1U 4 5345 RST 100 E 2 16204 a Z Bi 5 Ano 31 63 90 SCART CS5345 9 axa 231 395 caso 10 16 Bl anos PGADUTB 29 H PGADUTA 28 19 27 S AID LM R237 4439K _ C287 py 0 16 EE AINGA 26 204 S MDIOR 395 c289 10716 Micaras 25 MM1692XVBE 1 Fam ze 53 wet i I eto 2358 vec H E K e b P u lt lt lt 1 CIN cvesour 5 ER TD RUD RD RD S 8 BIAS 14 Como p 0 6 3 COMPOSITE ies 4 3 Y G 0UT m X cyout
91. p Clamp Upper Tray Disc Base Assembly Sled Gear Feed 4 Screws 1 Connector 1 Locking Tabs Gear Middle Gear Rack Rubber Rear Frame Assembly Up Down 1 Screw Belt Loading 1 Locking Tab Gear Pulley Gear Loading 1 Locking Tab Guide Up Down PWB Assembly Loading 1 Locking Tab 1 Hook 2Screw 1271813 Base Main 14 15 16 17 Note Quando remontar fa a procedimento em orden inversa O Baixo Bottom no na coluna Desmonte da tabela acima indica qual que devera ser desmontada no lado de Baixo 2 Locking Tabs Direitos de c pia 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento prop sitos de servi os DESMONTE DO MECANISMO DO DECK MAIN BASE 1 BASE PRINCIPAL FIG 4 1 1 1 Disco de Montagem do Grampo 1 Coloque o Disco de Montagem do Grampo conforme mostrado na figura A 2 Levante o Disco de Montagem do Grampo em dire o seta A 3 Separe o Disco de Montagem do Grampo do Prendedor do Grampo 1 1 1 Grampo da Placa 1 Gire o Grampo da Placa no sentido contr rio ao do movimento dos ponteiros do rel gio E depois levante o Grampo da Placa 1 1 2 Grampo do Magneto 1 1 3 Grampo Superior Direitos de c pia O 2008 LG Electronics Inc 4 3 Todos os direitos reservados Apenas para efeitos de treinamento e prop sitos de servi os
92. para uso Interno da LGE 1 4 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o INFORMA ES PARA MANUTEN O DE EEPROM DVD Status do LOGO DE DVD DETECTA NOVA EEPROM Status sem disco OP O EDIT SCREEN Controle remoto Tecla Pause gt 1 gt 4 gt 7 gt 2 em ordem Pressione os n meros 0 9 pressione os caracteres A F 1 6 momentaneamente Use as teclas direcionais 4 p V para mover para posi o adequada fa a as altera es Pressione a tecla Pause uma vez A altera o ser executada quando for ligado Direitos autorais 2008 LG Electronics Inc 1 5 Apenas para uso Interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o INFORMA ES PARA MANUTEN O DE EEPROM MICOM FLD sem status do disco Controle remoto 2 Front STOP apertar o mesmo tempo durante 5 DETECTA NOVA EEPROM segundos OP O EDIT SCREEN FLD OP 0 Use a tecla de seta 4 P V mover para a posic o apropriada e fazer as mudan as Pressione a tecla ENTER apenas uma vez FLD write ok ou up ok Controle remoto 2 Front STOP apertar mesmo tempo FLD mostra E2P CLR ou EP CLR Desligamento automatico Apenas para uso Interno da LGE 1 6 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos
93. po 20 EMO 21 22 STBY 23 24 JRIN 26 27 T USN 28 TE 29 Sg fis GND 30 d v 00 isi A506 SK 31 2 1 V 10 188 kS s 3 1 00 2 DC 1 40 V 4 2 DG STOPPED FIG 8 2 CD Apenas para uso Interno da LGE 2 20 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento de 9 SINAIS DE CONTROLE DO EIXO CONDI O SEM DISCO 18 Dec 82 Reading Floppy Disk Drive 6 54 58 1 2 5 1 00 4 1 B Eres 2 28s 2 1 88 V 2 3 2s 1 88 V T 5 s 11 Di 2 1 OC 188 kS s Bl v 2 DC 1 48 V 4 2 V DC STOPPED FIG 9 1 4 I3 V14 4 8 14 ngxr M 15 ori 16 wore 17 ipo 18 nos 19 AVDD33_2 an 30 yo po 21 22 SEL 23 TRAY CLOSE 2 m 25 too TEM 26 co eproo um 27 UsB_pP USEN Sop USB_DM Urr USB_V33 IC5O 1 MT 1389 JN 10 SINAL RELATIVO A CONTROLE DE TRACKING VERIFICA O DO SISTEMA 10 Dec 02 1 05 0
94. r do motor Verificar o circuito do AMP no driver do motor Apenas para uso Interno da LGE O laser liga NAO quando o disco lido Verificar o circuito de alimen ta o do laser em MT1389 L e a com transistor de pot ncia Q401 Q402 DVDLD ou CDLD tem sa da adequada Verificar os circuitos relaciona dos ao transistor de pot ncia do laser do coletor do transisto de pot ncia 6 normal Verificar do cabo entre transistor de saida cabe ote do captador NAO Disco colocado Laser desligado NAO Identifica o do disco est correta NAO O eixo est girando SIM Apenas para uso Interno da LGE Verificar os circuitos relacionados com o sinal RF de MT1389 L NAO Sinal RF adequado em MT1389 L SIM Verificar a conex o RF entre o AM5890 e MT1389 L Sinal do eixo adequado em MT1389 L verificar o circuito relacionado com eixo em MT1389 L Verificar o circuito de controle de eixo do amplificador do driver do motor NAO gt Sa da adequada em SPNP e SPNN Verificar a conex o do cabo entre o eixo e o PCB principal Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas par
95. rada para baixo Bottom Side lado de baixo 1 Solte o parafuso S4 2 Desprenda a Presilha L3 na dire o da seta e depois levante a Montagem da Moldura Cima Em baixo para que esta fique separada da Base Principal Note Durante a remontagem mova o Guia Cima Baixo na dire o da seta C at que ele se posicione conforme mostrado na Fig C Durante a remontagem insira a parte da Montagem da Moldura Cima Baixo na parte B do Guia Cima Baixo conforme aparece na Fig B 6 CARREGAMENTO DA CINTA FIG 4 4 CODE a Base Principal na posi o original Lado de Cima 7 CORREIA DE ENGRENAGEM FIG 4 4 1 Desprenda a presilha L4 na direc o da Seta e depois separe Correia de Engrenagem Base Principal 4 5 GUIDE UP DOWN S4 UP DOWN FRAME ASSEMBLY 8 CARREGAMENTO DA ENGRENAGEM FIG 4 4 9 GUIA CIMA BAIXO FIG 4 4 1 Mova a Guia Cima Baixo dire o da seta A conforme mostrado na Fig A 2 Empurre a Presilha L5 para baixo e levante a Guia Cima Baixo para que possa separa la da Base Principal Note Durante remontagem coloque Guia Cima Baixo con forme mostra Fig C e mova o na dire o da seta at que ele se prenda pelas Presilhas L5 E confirme que o Guia Cima Baixo esta de acordo com o mostrado na Fig A 10 CARREGANDO A MONTAGEM PWB FIG 4 4 Note Coloque a Base Principal com a face para baixo Bottom Side 1
96. rocess is programmable Internal pull down resistor EPD ENA TEST MODE 1 97 External amplifier power device enable output Active High Test Mode Test mode selection pin 1 In normal operation it should be LOW or not connected Internal pull down resistor TEST MODE2 98 Test mode selection pin 2 In normal operation it should be LOW or not connected Internal pull down resistor SCAN ENA 99 Scan enable Active High In normal operation it should be LOW or not connected Internal pull down resistor TEST MODES3 100 Test mode selection pin 3 In normal operation it should be LOW or not connected Internal pull down resistor All inputs and bi directional inputs are 5 Volt tolerant The corresponding pins can be connected to the buses that can swing between and 5V The output only pins are not 5V tolerant and the buses they are connected to can swing only between and 3 3V Apenas para uso Interno da LGE 2 44 Direitos autorais 22008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de DIAGRAMA DE FIA O
97. round 45W 45W Pot ncia de Saida 30W 4 Qat 1 kHz THD 10 Subwoofer 75W Pot ncia de Sa da 60W 8 Oat 30 Hz THD 10 ALTI FALANTES SH33SU Alto Falante Frontal Traseiro Central Subwoofer Passivo SH33SU S SH33SU W Impedancia 40 80 Dimens es 99 x 114 x 86 mm 156 x 325 x 320 mm Peso L quido 1EA 0 35 kg 3 5 kg ALTI FALANTES SH33SD Alto Falante Frontal Traseiro Central Subwoofer Passivo SH33SD S SH33SD W Impedancia 40 80 Dimens es 99 x 114 x 86 mm 156 x 325 x 320 mm Peso L quido 1EA 0 35 kg 3 5 kg Apenas para uso Interno da LGE 1 8 Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Apenas para efeitos de treinamento e de SECTION 2 SE O DA PARTE EL TRICA GUIA PARA SOLU O DE PROBLEMAS 1 CIRCUITO DE FORNECIMENTO DE ENERGIA CONECTE O DE FOR A NAO VERIFIQUE A TOMADA E O CIRCUITO DE FORNECIMENTO DE ENERGIA O indicador vermelho acende E LIGUE SIM VERIFIQUE O CIRCUITO DE ESTA LIGADO FORNECIMENTO DE ENERGIA NAO A LEITURA INICIAL FUNCIONA VERIFIQUE O CIRCUITO DO LASER SIM VERIFIQUE O CIRCUITO DO FOCO VERIFIQUE O DISCO NAO VERIFIQUE O CIRCUITO SERVO DE TRACKING H SA DA DE UDIO VERIFIQUE O CIRCUITO DE UDIO C Direitos autorais 2008 LG Electronics Inc 2 1 Apenas para uso Interno
98. t TRO Analog Output Tracking servo output PDM output of tracking servo compensator FOO Analog Output Focus servo output PDM output of focus servo compensator FG Analog 1 Motor Hall sensor input 2 GPIO USB DP USB DM Analog Input Analog Input USB port DPLUS analog pin USB port DMINUS analog pin VDD33 USB USB Power USB Power pin 3 3V VSS33 USB USB Ground USB ground pin PAD VRT Analog Inout USB generating reference current VDD18 USB USB Power USB Power pin 1 8V DACVDDC Power Power VREF Analog Bandgap reference voltage FS Analog Full scale adjustment suggest to use 560 ohm DACVSSC Ground Ground pin for video DAC circuitry CVBS Direitos autorais 2008 LG Electronics Inc Todos os direitos reservados Analog Apenas para efeitos de treinamento e de manuten o 2 27 Analog composite output Apenas para uso Interno da LGE Main DACVDDB Type Power Description 3 3V power pin for video DAC circuitry DACVDDA Power 3 3V power pin for video DAC circuitry Y G Analog Green Y SY or CVBS B CB PB Analog Blue CB PB or SC R CR PR AADVSS Analog Ground Red CR PR CVBS or SY Ground pin for 2ch audio ADC circuitry Audio ADC input 2 2 MS_CLK set B 3 MCDATA 4 Audio Mute 5 output 7 cr 1 ee audio ADC reference voltag
99. t 4mA PD Data mask 0 InOut 4 DRAM data 15 InOut 4mA InOut AMA DRAM data 13 DRAM data 1 DRAM data 2 DRAM data 4 DRAM data 7 DRAM data 14 Direitos autorais 2008 LG Electronics Inc 2 29 Apenas para uso Interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o Description InOut 4 DRAM data 12 InOut 4mA InOut 4mA InOut 4mA InOut AMA DRAM data 8 DRAM data 11 DRAM data 10 DRAM data 9 InOut 4ma PD Data mask 1 InOut 4 PD Dram clock InOut 4mA PD InOut 4mA PD InOut 4mA PD InOut 4mA PD InOut 4mA PD InOut 4mA PD InOut 4mA PD Output 4mA PD Output 4 column address strobe active low Output 4mA PD InOut 4mA PD InOut 4mA PD InOut 4mA PD InOut 4mA PD InOut 4mA PD InOut 4mA PD InOut 4mA PD DRAM address bit 11 DRAM address 9 DRAM address 8 DRAM address 7 DRAM address 6 DRAM address 5 DRAM address 4 DRAM Write enable active low DRAM row address strobe active low DRAM bank address 0 DRAM bank address 1 DRAM address 10 DRAM address 0 DRAM address 1 DRAM address 2 DRAM address 3 1 GPIO 7 2 Dram Clock Enable InOut 3 MS_CLK set A 4mA PD 4 Audio Mute 5 HSYN VSYN input 6 C0 GPIO 6 1 GPIO8 2 MS_BS set A 3
100. t 5 Resi i 1800 pF 10 uF 100 k Note 1 Resistors are required for IC control port operation Ne 100k 1800pFT 1 e NC AIN5B c Right Analog Input 5 Note 2 The value of R is ver dictated by the microphone AINA Left Analog Input carteridge T 1800pF _ 100 100k 5 V TSTO 1800 pF T ma 100 7906 AIN6B c Right Analog Input 6 MICBIAS See 2 gt R gt 47uF AGND FILT AGND 12 op IB a7 uE 0 1 pF AFILTA 2 2nF 2 2nF AGND AFILTB DGND Capacitors must be C0G or equivalent N Mig Direitos autorais 2008 LG Electronics Inc 2 39 Apenas para uso Interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento de manuten o DESCRI O DO PIN Serial ControlData Input Output SDA is data I O in IC Mode CDOUT is the output data line for SDA CDOUT TM the control port interface in SPI Mode SCL CCLK 2 Serial ControlPort Clock Input Serial clock for the serial control port s Address Bit0 IC ntrolPort Chip Select SPI Input ADO is a chip address in IC Mode ADO CS 3 CS is the chip select signal for SPI format AD1 CDIN 4 Address Bit1 IC Ser ial ControlData Input SPI Input AD1 is a chip address pin in IC Mode
101. uidado portanto para evitar reparo ou armazenagem onde a temperatura da umidade for alta onde hou ver forte magnetismo ou onde houver excesso de p 2 Notas de reparo 1 Antes de substituir um componente desconecte primeiro o cabo de alimenta o do aparelho 2 Todos os equipamentos instrumentos de medi o e ferramentas devem estar aterrados 3 bancada deve ser coberta com uma manta condutiva e aterrada Quando remover o captador laser de sua embalagem condutiva n o coloque o captador na embalagem Por que h a possibilidade de dano por eletricidade est tica 4 Para evitar escoamento el trico a parte met lica do ferro de solda deve estar aterrada 5 Os trabalhadores devem estar aterrados por uma pulseira de aterramento 6 Deve se tomar cuidado para n o permitir que o captador laser entre em contato com o vestu rio para evi tar que as cargas de eletricidade est tica escapem da pulseira de aterramento 7 O feixe de laser do captador NUNCA deve ser direcionado diretamente para os olhos ou pele Pulseira de aterramento Resistor 1 Resistor Manta con 1 dutiva Direitos autorais 2008 LG Electronics Inc 1 3 Apenas para uso Interno da LGE Todos os direitos reservados Apenas para efeitos de treinamento e de manuten o PRECAU ES CONTRA ESD Dispositivos Eletrostaticamente Sens veis ESD Alguns dispositivos semicondutores em estado s lido podem ser danificados
102. ut4 Microphonelnput 1 4 2 Input The full scale level is specified in the ADC AIN4B MICIN2 22 Analog Characteristics specification table 23 Stereo Analog Input5 Input The full scale level is specified in the ADC Analog Characteristics AIN5B 24 specification table MICBIAS 25 MicrophoneBias Supply Output Low noise bias supply for external microphone Electrical charac teristics are specified in the DC Electrical Characteristics specification table AIN6A 26 Stereo Analog Input6 Input The full scale level is specified in the ADC Analog Characteristics AIN6B 27 specification table PGAOUTA 28 PGA Analog AudioOutput Output Either an analog output from the PGA block or high impedance PGAOUTB 29 VA 30 Analog Power Input Positive power for the internal analog section AGND Analog Ground Input Ground reference for the internal analog section NC 33 Connect These pins are not connected internally and should be tied to ground to minimize any 34 potential coupling effects TSTO 35 Test Pin Output This pin must be left unconnected VLS 36 Serial Audiolnterface Power Input Determines the required signal level for the serial audio inter face Refer to the Recommended Operating Conditions for appropriate voltages TSTI 37 Test Pin Input This pin must be connected to ground NC q No Connect These pins are not connected internally and should be tied to ground to minimize any 40 potential coupling effects SDOUT 41
103. x C274 C284 10 16 TUNER Mure cour lie 1 C275 p 470 6 3 PB 8 0UT 3B LI PRA C285 y 10 16 R238 jw 39K PTB R Cog o3 C286 15 10 16 8239 Wy PIEL 5 10 H COIN E amp ajx 2 SIR E 7 H H he wal ss g 1071 2 R B t SIR R G 8 VIDEO GND 6 ONLY RCA USED 5 4 SCART OPTION 1 3 Pee ae ee tee ee dE ER ESTE DS E PAi a RS ar adr 586 dida VIA 8 3 8 8 B 1 i S x 1 1 1 1 8 g 3 a 5 8 8 8 5 FF 3 3 5 3 3 E 50 2 8 1 el 8 e 1 y 9201 R222 1 75 0 0 0 48 1 lt x xx 42 H z m E 3307560 1 5 lt cz oc acr ES 8 g IZA gt 5545 5 lt Bs3925 gt 3 Pe i FaR E ora P E 1 1 2 88 8 T s Se 8 I DIMENSIONAL TOLERANCE c os preme B i A 2 RARE z e N 115 m 1 i 8 eles 6 5 5 8 8 5 5 s le 1 2 2 216 5 8

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